AVRGenInstrInfo.inc source code [llvm_projects/build/lib/Target/AVR/AVRGenInstrInfo.inc]

1	/===- TableGen'erated file -------------------------------------- C++ --===\
2	\| \|
3	\| Target Instruction Enum Values and Descriptors \|
4	\| \|
5	\| Automatically generated file, do not edit! \|
6	\| \|
7	\===----------------------------------------------------------------------===/
8
9	#ifdef GET_INSTRINFO_ENUM
10	#undef GET_INSTRINFO_ENUM
11
12	namespace llvm::AVR {
13
14	enum {
15	PHI = `0`, // Target.td:1301
16	INLINEASM = `1`, // Target.td:1307
17	INLINEASM_BR = `2`, // Target.td:1313
18	CFI_INSTRUCTION = `3`, // Target.td:1322
19	EH_LABEL = `4`, // Target.td:1331
20	GC_LABEL = `5`, // Target.td:1340
21	ANNOTATION_LABEL = `6`, // Target.td:1349
22	KILL = `7`, // Target.td:1357
23	EXTRACT_SUBREG = `8`, // Target.td:1364
24	INSERT_SUBREG = `9`, // Target.td:1370
25	IMPLICIT_DEF = `10`, // Target.td:1377
26	INIT_UNDEF = `11`, // Target.td:1386
27	SUBREG_TO_REG = `12`, // Target.td:1393
28	COPY_TO_REGCLASS = `13`, // Target.td:1399
29	DBG_VALUE = `14`, // Target.td:1406
30	DBG_VALUE_LIST = `15`, // Target.td:1413
31	DBG_INSTR_REF = `16`, // Target.td:1420
32	DBG_PHI = `17`, // Target.td:1427
33	DBG_LABEL = `18`, // Target.td:1434
34	REG_SEQUENCE = `19`, // Target.td:1441
35	COPY = `20`, // Target.td:1448
36	COPY_LANEMASK = `21`, // Target.td:1456
37	BUNDLE = `22`, // Target.td:1463
38	LIFETIME_START = `23`, // Target.td:1469
39	LIFETIME_END = `24`, // Target.td:1476
40	PSEUDO_PROBE = `25`, // Target.td:1483
41	ARITH_FENCE = `26`, // Target.td:1490
42	STACKMAP = `27`, // Target.td:1499
43	FENTRY_CALL = `28`, // Target.td:1634
44	PATCHPOINT = `29`, // Target.td:1507
45	LOAD_STACK_GUARD = `30`, // Target.td:1525
46	PREALLOCATED_SETUP = `31`, // Target.td:1533
47	PREALLOCATED_ARG = `32`, // Target.td:1539
48	STATEPOINT = `33`, // Target.td:1516
49	LOCAL_ESCAPE = `34`, // Target.td:1545
50	FAULTING_OP = `35`, // Target.td:1554
51	PATCHABLE_OP = `36`, // Target.td:1574
52	PATCHABLE_FUNCTION_ENTER = `37`, // Target.td:1582
53	PATCHABLE_RET = `38`, // Target.td:1589
54	PATCHABLE_FUNCTION_EXIT = `39`, // Target.td:1598
55	PATCHABLE_TAIL_CALL = `40`, // Target.td:1606
56	PATCHABLE_EVENT_CALL = `41`, // Target.td:1614
57	PATCHABLE_TYPED_EVENT_CALL = `42`, // Target.td:1624
58	ICALL_BRANCH_FUNNEL = `43`, // Target.td:1644
59	FAKE_USE = `44`, // Target.td:1564
60	MEMBARRIER = `45`, // Target.td:1650
61	JUMP_TABLE_DEBUG_INFO = `46`, // Target.td:1658
62	RELOC_NONE = `47`, // Target.td:1666
63	CONVERGENCECTRL_ENTRY = `48`, // Target.td:1678
64	CONVERGENCECTRL_ANCHOR = `49`, // Target.td:1674
65	CONVERGENCECTRL_LOOP = `50`, // Target.td:1682
66	CONVERGENCECTRL_GLUE = `51`, // Target.td:1686
67	G_ASSERT_SEXT = `52`, // GenericOpcodes.td:1867
68	G_ASSERT_ZEXT = `53`, // GenericOpcodes.td:1859
69	G_ASSERT_ALIGN = `54`, // GenericOpcodes.td:1874
70	G_ADD = `55`, // GenericOpcodes.td:300
71	G_SUB = `56`, // GenericOpcodes.td:308
72	G_MUL = `57`, // GenericOpcodes.td:316
73	G_SDIV = `58`, // GenericOpcodes.td:324
74	G_UDIV = `59`, // GenericOpcodes.td:332
75	G_SREM = `60`, // GenericOpcodes.td:340
76	G_UREM = `61`, // GenericOpcodes.td:348
77	G_SDIVREM = `62`, // GenericOpcodes.td:356
78	G_UDIVREM = `63`, // GenericOpcodes.td:364
79	G_AND = `64`, // GenericOpcodes.td:372
80	G_OR = `65`, // GenericOpcodes.td:380
81	G_XOR = `66`, // GenericOpcodes.td:388
82	G_ABDS = `67`, // GenericOpcodes.td:417
83	G_ABDU = `68`, // GenericOpcodes.td:425
84	G_UAVGFLOOR = `69`, // GenericOpcodes.td:433
85	G_UAVGCEIL = `70`, // GenericOpcodes.td:440
86	G_SAVGFLOOR = `71`, // GenericOpcodes.td:447
87	G_SAVGCEIL = `72`, // GenericOpcodes.td:454
88	G_IMPLICIT_DEF = `73`, // GenericOpcodes.td:110
89	G_PHI = `74`, // GenericOpcodes.td:116
90	G_FRAME_INDEX = `75`, // GenericOpcodes.td:122
91	G_GLOBAL_VALUE = `76`, // GenericOpcodes.td:128
92	G_PTRAUTH_GLOBAL_VALUE = `77`, // GenericOpcodes.td:134
93	G_CONSTANT_POOL = `78`, // GenericOpcodes.td:140
94	G_EXTRACT = `79`, // GenericOpcodes.td:1474
95	G_UNMERGE_VALUES = `80`, // GenericOpcodes.td:1486
96	G_INSERT = `81`, // GenericOpcodes.td:1494
97	G_MERGE_VALUES = `82`, // GenericOpcodes.td:1504
98	G_BUILD_VECTOR = `83`, // GenericOpcodes.td:1523
99	G_BUILD_VECTOR_TRUNC = `84`, // GenericOpcodes.td:1532
100	G_CONCAT_VECTORS = `85`, // GenericOpcodes.td:1539
101	G_PTRTOINT = `86`, // GenericOpcodes.td:152
102	G_INTTOPTR = `87`, // GenericOpcodes.td:146
103	G_BITCAST = `88`, // GenericOpcodes.td:158
104	G_FREEZE = `89`, // GenericOpcodes.td:277
105	G_CONSTANT_FOLD_BARRIER = `90`, // GenericOpcodes.td:1881
106	G_INTRINSIC_FPTRUNC_ROUND = `91`, // GenericOpcodes.td:1263
107	G_INTRINSIC_TRUNC = `92`, // GenericOpcodes.td:1269
108	G_INTRINSIC_ROUND = `93`, // GenericOpcodes.td:1275
109	G_INTRINSIC_LRINT = `94`, // GenericOpcodes.td:1281
110	G_INTRINSIC_LLRINT = `95`, // GenericOpcodes.td:1287
111	G_INTRINSIC_ROUNDEVEN = `96`, // GenericOpcodes.td:1293
112	G_READCYCLECOUNTER = `97`, // GenericOpcodes.td:1299
113	G_READSTEADYCOUNTER = `98`, // GenericOpcodes.td:1305
114	G_LOAD = `99`, // GenericOpcodes.td:1332
115	G_SEXTLOAD = `100`, // GenericOpcodes.td:1340
116	G_ZEXTLOAD = `101`, // GenericOpcodes.td:1348
117	G_INDEXED_LOAD = `102`, // GenericOpcodes.td:1358
118	G_INDEXED_SEXTLOAD = `103`, // GenericOpcodes.td:1366
119	G_INDEXED_ZEXTLOAD = `104`, // GenericOpcodes.td:1374
120	G_STORE = `105`, // GenericOpcodes.td:1382
121	G_INDEXED_STORE = `106`, // GenericOpcodes.td:1390
122	G_ATOMIC_CMPXCHG_WITH_SUCCESS = `107`, // GenericOpcodes.td:1400
123	G_ATOMIC_CMPXCHG = `108`, // GenericOpcodes.td:1410
124	G_ATOMICRMW_XCHG = `109`, // GenericOpcodes.td:1428
125	G_ATOMICRMW_ADD = `110`, // GenericOpcodes.td:1429
126	G_ATOMICRMW_SUB = `111`, // GenericOpcodes.td:1430
127	G_ATOMICRMW_AND = `112`, // GenericOpcodes.td:1431
128	G_ATOMICRMW_NAND = `113`, // GenericOpcodes.td:1432
129	G_ATOMICRMW_OR = `114`, // GenericOpcodes.td:1433
130	G_ATOMICRMW_XOR = `115`, // GenericOpcodes.td:1434
131	G_ATOMICRMW_MAX = `116`, // GenericOpcodes.td:1435
132	G_ATOMICRMW_MIN = `117`, // GenericOpcodes.td:1436
133	G_ATOMICRMW_UMAX = `118`, // GenericOpcodes.td:1437
134	G_ATOMICRMW_UMIN = `119`, // GenericOpcodes.td:1438
135	G_ATOMICRMW_FADD = `120`, // GenericOpcodes.td:1439
136	G_ATOMICRMW_FSUB = `121`, // GenericOpcodes.td:1440
137	G_ATOMICRMW_FMAX = `122`, // GenericOpcodes.td:1441
138	G_ATOMICRMW_FMIN = `123`, // GenericOpcodes.td:1442
139	G_ATOMICRMW_FMAXIMUM = `124`, // GenericOpcodes.td:1443
140	G_ATOMICRMW_FMINIMUM = `125`, // GenericOpcodes.td:1444
141	G_ATOMICRMW_FMAXIMUMNUM = `126`, // GenericOpcodes.td:1445
142	G_ATOMICRMW_FMINIMUMNUM = `127`, // GenericOpcodes.td:1446
143	G_ATOMICRMW_UINC_WRAP = `128`, // GenericOpcodes.td:1447
144	G_ATOMICRMW_UDEC_WRAP = `129`, // GenericOpcodes.td:1448
145	G_ATOMICRMW_USUB_COND = `130`, // GenericOpcodes.td:1449
146	G_ATOMICRMW_USUB_SAT = `131`, // GenericOpcodes.td:1450
147	G_FENCE = `132`, // GenericOpcodes.td:1452
148	G_PREFETCH = `133`, // GenericOpcodes.td:1459
149	G_BRCOND = `134`, // GenericOpcodes.td:1594
150	G_BRINDIRECT = `135`, // GenericOpcodes.td:1603
151	G_INVOKE_REGION_START = `136`, // GenericOpcodes.td:1626
152	G_INTRINSIC = `137`, // GenericOpcodes.td:1546
153	G_INTRINSIC_W_SIDE_EFFECTS = `138`, // GenericOpcodes.td:1553
154	G_INTRINSIC_CONVERGENT = `139`, // GenericOpcodes.td:1562
155	G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS = `140`, // GenericOpcodes.td:1570
156	G_ANYEXT = `141`, // GenericOpcodes.td:44
157	G_TRUNC = `142`, // GenericOpcodes.td:83
158	G_TRUNC_SSAT_S = `143`, // GenericOpcodes.td:90
159	G_TRUNC_SSAT_U = `144`, // GenericOpcodes.td:97
160	G_TRUNC_USAT_U = `145`, // GenericOpcodes.td:104
161	G_CONSTANT = `146`, // GenericOpcodes.td:165
162	G_FCONSTANT = `147`, // GenericOpcodes.td:172
163	G_VASTART = `148`, // GenericOpcodes.td:178
164	G_VAARG = `149`, // GenericOpcodes.td:185
165	G_SEXT = `150`, // GenericOpcodes.td:52
166	G_SEXT_INREG = `151`, // GenericOpcodes.td:66
167	G_ZEXT = `152`, // GenericOpcodes.td:74
168	G_SHL = `153`, // GenericOpcodes.td:396
169	G_LSHR = `154`, // GenericOpcodes.td:403
170	G_ASHR = `155`, // GenericOpcodes.td:410
171	G_FSHL = `156`, // GenericOpcodes.td:462
172	G_FSHR = `157`, // GenericOpcodes.td:470
173	G_ROTR = `158`, // GenericOpcodes.td:477
174	G_ROTL = `159`, // GenericOpcodes.td:484
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177	G_SCMP = `162`, // GenericOpcodes.td:505
178	G_UCMP = `163`, // GenericOpcodes.td:512
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180	G_UADDO = `165`, // GenericOpcodes.td:584
181	G_UADDE = `166`, // GenericOpcodes.td:592
182	G_USUBO = `167`, // GenericOpcodes.td:614
183	G_USUBE = `168`, // GenericOpcodes.td:620
184	G_SADDO = `169`, // GenericOpcodes.td:599
185	G_SADDE = `170`, // GenericOpcodes.td:607
186	G_SSUBO = `171`, // GenericOpcodes.td:627
187	G_SSUBE = `172`, // GenericOpcodes.td:634
188	G_UMULO = `173`, // GenericOpcodes.td:641
189	G_SMULO = `174`, // GenericOpcodes.td:649
190	G_UMULH = `175`, // GenericOpcodes.td:658
191	G_SMULH = `176`, // GenericOpcodes.td:667
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194	G_USUBSAT = `179`, // GenericOpcodes.td:695
195	G_SSUBSAT = `180`, // GenericOpcodes.td:703
196	G_USHLSAT = `181`, // GenericOpcodes.td:711
197	G_SSHLSAT = `182`, // GenericOpcodes.td:719
198	G_SMULFIX = `183`, // GenericOpcodes.td:731
199	G_UMULFIX = `184`, // GenericOpcodes.td:738
200	G_SMULFIXSAT = `185`, // GenericOpcodes.td:748
201	G_UMULFIXSAT = `186`, // GenericOpcodes.td:755
202	G_SDIVFIX = `187`, // GenericOpcodes.td:766
203	G_UDIVFIX = `188`, // GenericOpcodes.td:773
204	G_SDIVFIXSAT = `189`, // GenericOpcodes.td:783
205	G_UDIVFIXSAT = `190`, // GenericOpcodes.td:790
206	G_FADD = `191`, // GenericOpcodes.td:963
207	G_FSUB = `192`, // GenericOpcodes.td:971
208	G_FMUL = `193`, // GenericOpcodes.td:979
209	G_FMA = `194`, // GenericOpcodes.td:988
210	G_FMAD = `195`, // GenericOpcodes.td:997
211	G_FDIV = `196`, // GenericOpcodes.td:1005
212	G_FREM = `197`, // GenericOpcodes.td:1012
213	G_FMODF = `198`, // GenericOpcodes.td:1019
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216	G_FEXP = `201`, // GenericOpcodes.td:1040
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221	G_FLOG10 = `206`, // GenericOpcodes.td:1075
222	G_FLDEXP = `207`, // GenericOpcodes.td:1082
223	G_FFREXP = `208`, // GenericOpcodes.td:1089
224	G_FNEG = `209`, // GenericOpcodes.td:801
225	G_FPEXT = `210`, // GenericOpcodes.td:807
226	G_FPTRUNC = `211`, // GenericOpcodes.td:813
227	G_FPTOSI = `212`, // GenericOpcodes.td:819
228	G_FPTOUI = `213`, // GenericOpcodes.td:825
229	G_SITOFP = `214`, // GenericOpcodes.td:831
230	G_UITOFP = `215`, // GenericOpcodes.td:837
231	G_FPTOSI_SAT = `216`, // GenericOpcodes.td:843
232	G_FPTOUI_SAT = `217`, // GenericOpcodes.td:849
233	G_FABS = `218`, // GenericOpcodes.td:855
234	G_FCOPYSIGN = `219`, // GenericOpcodes.td:861
235	G_IS_FPCLASS = `220`, // GenericOpcodes.td:874
236	G_FCANONICALIZE = `221`, // GenericOpcodes.td:867
237	G_FMINNUM = `222`, // GenericOpcodes.td:887
238	G_FMAXNUM = `223`, // GenericOpcodes.td:894
239	G_FMINNUM_IEEE = `224`, // GenericOpcodes.td:912
240	G_FMAXNUM_IEEE = `225`, // GenericOpcodes.td:919
241	G_FMINIMUM = `226`, // GenericOpcodes.td:929
242	G_FMAXIMUM = `227`, // GenericOpcodes.td:936
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250	G_RESET_FPMODE = `235`, // GenericOpcodes.td:1254
251	G_GET_ROUNDING = `236`, // GenericOpcodes.td:1311
252	G_SET_ROUNDING = `237`, // GenericOpcodes.td:1317
253	G_PTR_ADD = `238`, // GenericOpcodes.td:526
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255	G_SMIN = `240`, // GenericOpcodes.td:541
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257	G_UMIN = `242`, // GenericOpcodes.td:557
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260	G_LROUND = `245`, // GenericOpcodes.td:283
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268	G_EXTRACT_VECTOR_ELT = `253`, // GenericOpcodes.td:1679
269	G_SHUFFLE_VECTOR = `254`, // GenericOpcodes.td:1689
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272	G_VECTOR_COMPRESS = `257`, // GenericOpcodes.td:1710
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275	G_CTLZ = `260`, // GenericOpcodes.td:193
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277	G_CTLS = `262`, // GenericOpcodes.td:217
278	G_CTPOP = `263`, // GenericOpcodes.td:223
279	G_BSWAP = `264`, // GenericOpcodes.td:229
280	G_BITREVERSE = `265`, // GenericOpcodes.td:235
281	G_FCEIL = `266`, // GenericOpcodes.td:1096
282	G_FCOS = `267`, // GenericOpcodes.td:1103
283	G_FSIN = `268`, // GenericOpcodes.td:1110
284	G_FSINCOS = `269`, // GenericOpcodes.td:1117
285	G_FTAN = `270`, // GenericOpcodes.td:1124
286	G_FACOS = `271`, // GenericOpcodes.td:1131
287	G_FASIN = `272`, // GenericOpcodes.td:1138
288	G_FATAN = `273`, // GenericOpcodes.td:1145
289	G_FATAN2 = `274`, // GenericOpcodes.td:1152
290	G_FCOSH = `275`, // GenericOpcodes.td:1159
291	G_FSINH = `276`, // GenericOpcodes.td:1166
292	G_FTANH = `277`, // GenericOpcodes.td:1173
293	G_FSQRT = `278`, // GenericOpcodes.td:1183
294	G_FFLOOR = `279`, // GenericOpcodes.td:1190
295	G_FRINT = `280`, // GenericOpcodes.td:1197
296	G_FNEARBYINT = `281`, // GenericOpcodes.td:1204
297	G_ADDRSPACE_CAST = `282`, // GenericOpcodes.td:241
298	G_BLOCK_ADDR = `283`, // GenericOpcodes.td:247
299	G_JUMP_TABLE = `284`, // GenericOpcodes.td:253
300	G_DYN_STACKALLOC = `285`, // GenericOpcodes.td:259
301	G_STACKSAVE = `286`, // GenericOpcodes.td:265
302	G_STACKRESTORE = `287`, // GenericOpcodes.td:271
303	G_STRICT_FADD = `288`, // GenericOpcodes.td:1760
304	G_STRICT_FSUB = `289`, // GenericOpcodes.td:1761
305	G_STRICT_FMUL = `290`, // GenericOpcodes.td:1762
306	G_STRICT_FDIV = `291`, // GenericOpcodes.td:1763
307	G_STRICT_FREM = `292`, // GenericOpcodes.td:1764
308	G_STRICT_FMA = `293`, // GenericOpcodes.td:1765
309	G_STRICT_FSQRT = `294`, // GenericOpcodes.td:1766
310	G_STRICT_FLDEXP = `295`, // GenericOpcodes.td:1767
311	G_READ_REGISTER = `296`, // GenericOpcodes.td:1633
312	G_WRITE_REGISTER = `297`, // GenericOpcodes.td:1643
313	G_MEMCPY = `298`, // GenericOpcodes.td:1773
314	G_MEMCPY_INLINE = `299`, // GenericOpcodes.td:1781
315	G_MEMMOVE = `300`, // GenericOpcodes.td:1789
316	G_MEMSET = `301`, // GenericOpcodes.td:1797
317	G_BZERO = `302`, // GenericOpcodes.td:1804
318	G_TRAP = `303`, // GenericOpcodes.td:1814
319	G_DEBUGTRAP = `304`, // GenericOpcodes.td:1821
320	G_UBSANTRAP = `305`, // GenericOpcodes.td:1827
321	G_VECREDUCE_SEQ_FADD = `306`, // GenericOpcodes.td:1726
322	G_VECREDUCE_SEQ_FMUL = `307`, // GenericOpcodes.td:1732
323	G_VECREDUCE_FADD = `308`, // GenericOpcodes.td:1738
324	G_VECREDUCE_FMUL = `309`, // GenericOpcodes.td:1739
325	G_VECREDUCE_FMAX = `310`, // GenericOpcodes.td:1741
326	G_VECREDUCE_FMIN = `311`, // GenericOpcodes.td:1742
327	G_VECREDUCE_FMAXIMUM = `312`, // GenericOpcodes.td:1743
328	G_VECREDUCE_FMINIMUM = `313`, // GenericOpcodes.td:1744
329	G_VECREDUCE_ADD = `314`, // GenericOpcodes.td:1746
330	G_VECREDUCE_MUL = `315`, // GenericOpcodes.td:1747
331	G_VECREDUCE_AND = `316`, // GenericOpcodes.td:1748
332	G_VECREDUCE_OR = `317`, // GenericOpcodes.td:1749
333	G_VECREDUCE_XOR = `318`, // GenericOpcodes.td:1750
334	G_VECREDUCE_SMAX = `319`, // GenericOpcodes.td:1751
335	G_VECREDUCE_SMIN = `320`, // GenericOpcodes.td:1752
336	G_VECREDUCE_UMAX = `321`, // GenericOpcodes.td:1753
337	G_VECREDUCE_UMIN = `322`, // GenericOpcodes.td:1754
338	G_SBFX = `323`, // GenericOpcodes.td:1839
339	G_UBFX = `324`, // GenericOpcodes.td:1847
340	ADCWRdRr = `325`, // AVRInstrInfo.td:397
341	ADDWRdRr = `326`, // AVRInstrInfo.td:378
342	ADJCALLSTACKDOWN = `327`, // AVRInstrInfo.td:346
343	ADJCALLSTACKUP = `328`, // AVRInstrInfo.td:356
344	ANDIWRdK = `329`, // AVRInstrInfo.td:583
345	ANDWRdRr = `330`, // AVRInstrInfo.td:543
346	ASRBNRd = `331`, // AVRInstrInfo.td:1357
347	ASRWLoRd = `332`, // AVRInstrInfo.td:1364
348	ASRWNRd = `333`, // AVRInstrInfo.td:1353
349	ASRWRd = `334`, // AVRInstrInfo.td:1361
350	Asr16 = `335`, // AVRInstrInfo.td:1625
351	Asr32 = `336`, // AVRInstrInfo.td:1629
352	Asr8 = `337`, // AVRInstrInfo.td:1621
353	AtomicFence = `338`, // AVRInstrInfo.td:1044
354	AtomicLoad16 = `339`, // AVRInstrInfo.td:1022
355	AtomicLoad8 = `340`, // AVRInstrInfo.td:1021
356	AtomicLoadAdd16 = `341`, // AVRInstrInfo.td:1032
357	AtomicLoadAdd8 = `342`, // AVRInstrInfo.td:1031
358	AtomicLoadAnd16 = `343`, // AVRInstrInfo.td:1036
359	AtomicLoadAnd8 = `344`, // AVRInstrInfo.td:1035
360	AtomicLoadOr16 = `345`, // AVRInstrInfo.td:1038
361	AtomicLoadOr8 = `346`, // AVRInstrInfo.td:1037
362	AtomicLoadSub16 = `347`, // AVRInstrInfo.td:1034
363	AtomicLoadSub8 = `348`, // AVRInstrInfo.td:1033
364	AtomicLoadXor16 = `349`, // AVRInstrInfo.td:1040
365	AtomicLoadXor8 = `350`, // AVRInstrInfo.td:1039
366	AtomicStore16 = `351`, // AVRInstrInfo.td:1025
367	AtomicStore8 = `352`, // AVRInstrInfo.td:1024
368	COMWRd = `353`, // AVRInstrInfo.td:613
369	CPCWRdRr = `354`, // AVRInstrInfo.td:736
370	CPWRdRr = `355`, // AVRInstrInfo.td:721
371	CopyZero = `356`, // AVRInstrInfo.td:1637
372	ELPMBRdZ = `357`, // AVRInstrInfo.td:1221
373	ELPMBRdZPi = `358`, // AVRInstrInfo.td:1233
374	ELPMWRdZ = `359`, // AVRInstrInfo.td:1226
375	ELPMWRdZPi = `360`, // AVRInstrInfo.td:1237
376	EORWRdRr = `361`, // AVRInstrInfo.td:569
377	FRMIDX = `362`, // AVRInstrInfo.td:1530
378	INWRdA = `363`, // AVRInstrInfo.td:1261
379	LDDWRdPtrQ = `364`, // AVRInstrInfo.td:970
380	LDDWRdYQ = `365`, // AVRInstrInfo.td:991
381	LDIWRdK = `366`, // AVRInstrInfo.td:874
382	LDSWRdK = `367`, // AVRInstrInfo.td:894
383	LDWRdPtr = `368`, // AVRInstrInfo.td:917
384	LDWRdPtrPd = `369`, // AVRInstrInfo.td:947
385	LDWRdPtrPi = `370`, // AVRInstrInfo.td:934
386	LPMBRdZ = `371`, // AVRInstrInfo.td:1179
387	LPMWRdZ = `372`, // AVRInstrInfo.td:1183
388	LPMWRdZPi = `373`, // AVRInstrInfo.td:1198
389	LSLBNRd = `374`, // AVRInstrInfo.td:1329
390	LSLWHiRd = `375`, // AVRInstrInfo.td:1322
391	LSLWNRd = `376`, // AVRInstrInfo.td:1325
392	LSLWRd = `377`, // AVRInstrInfo.td:1319
393	LSRBNRd = `378`, // AVRInstrInfo.td:1346
394	LSRWLoRd = `379`, // AVRInstrInfo.td:1339
395	LSRWNRd = `380`, // AVRInstrInfo.td:1342
396	LSRWRd = `381`, // AVRInstrInfo.td:1336
397	Lsl16 = `382`, // AVRInstrInfo.td:1581
398	Lsl32 = `383`, // AVRInstrInfo.td:1585
399	Lsl8 = `384`, // AVRInstrInfo.td:1577
400	Lsr16 = `385`, // AVRInstrInfo.td:1595
401	Lsr32 = `386`, // AVRInstrInfo.td:1599
402	Lsr8 = `387`, // AVRInstrInfo.td:1591
403	NEGWRd = `388`, // AVRInstrInfo.td:625
404	ORIWRdK = `389`, // AVRInstrInfo.td:596
405	ORWRdRr = `390`, // AVRInstrInfo.td:556
406	OUTWARr = `391`, // AVRInstrInfo.td:1270
407	POPWRd = `392`, // AVRInstrInfo.td:1291
408	PUSHWRr = `393`, // AVRInstrInfo.td:1282
409	ROLBRdR1 = `394`, // AVRInstrInfo.td:1368
410	ROLBRdR17 = `395`, // AVRInstrInfo.td:1373
411	ROLWRd = `396`, // AVRInstrInfo.td:1382
412	RORBRd = `397`, // AVRInstrInfo.td:1377
413	RORWRd = `398`, // AVRInstrInfo.td:1388
414	Rol16 = `399`, // AVRInstrInfo.td:1609
415	Rol8 = `400`, // AVRInstrInfo.td:1605
416	Ror16 = `401`, // AVRInstrInfo.td:1617
417	Ror8 = `402`, // AVRInstrInfo.td:1613
418	SBCIWRdK = `403`, // AVRInstrInfo.td:469
419	SBCWRdRr = `404`, // AVRInstrInfo.td:458
420	SEXT = `405`, // AVRInstrInfo.td:1522
421	SPREAD = `406`, // AVRInstrInfo.td:1558
422	SPWRITE = `407`, // AVRInstrInfo.td:1561
423	STDSPQRr = `408`, // AVRInstrInfo.td:1545
424	STDWPtrQRr = `409`, // AVRInstrInfo.td:1167
425	STDWSPQRr = `410`, // AVRInstrInfo.td:1552
426	STSWKRr = `411`, // AVRInstrInfo.td:1065
427	STWPtrPdRr = `412`, // AVRInstrInfo.td:1137
428	STWPtrPiRr = `413`, // AVRInstrInfo.td:1112
429	STWPtrRr = `414`, // AVRInstrInfo.td:1088
430	SUBIWRdK = `415`, // AVRInstrInfo.td:438
431	SUBWRdRr = `416`, // AVRInstrInfo.td:425
432	Select16 = `417`, // AVRInstrInfo.td:1571
433	Select8 = `418`, // AVRInstrInfo.td:1565
434	ZEXT = `419`, // AVRInstrInfo.td:1525
435	ADCRdRr = `420`, // AVRInstrInfo.td:385
436	ADDRdRr = `421`, // AVRInstrInfo.td:368
437	ADIWRdK = `422`, // AVRInstrInfo.td:403
438	ANDIRdK = `423`, // AVRInstrInfo.td:574
439	ANDRdRr = `424`, // AVRInstrInfo.td:534
440	ASRRd = `425`, // AVRInstrInfo.td:1350
441	BCLRs = `426`, // AVRInstrInfo.td:1446
442	BLD = `427`, // AVRInstrInfo.td:1419
443	BRBCsk = `428`, // AVRInstrInfo.td:775
444	BRBSsk = `429`, // AVRInstrInfo.td:770
445	BREAK = `430`, // AVRInstrInfo.td:1490
446	BREQk = `431`, // AVRInstrInfo.td:826
447	BRGEk = `432`, // AVRInstrInfo.td:844
448	BRLOk = `433`, // AVRInstrInfo.td:835
449	BRLTk = `434`, // AVRInstrInfo.td:847
450	BRMIk = `435`, // AVRInstrInfo.td:838
451	BRNEk = `436`, // AVRInstrInfo.td:829
452	BRPLk = `437`, // AVRInstrInfo.td:841
453	BRSHk = `438`, // AVRInstrInfo.td:832
454	BSETs = `439`, // AVRInstrInfo.td:1445
455	BST = `440`, // AVRInstrInfo.td:1416
456	CALLk = `441`, // AVRInstrInfo.td:688
457	CBIAb = `442`, // AVRInstrInfo.td:1408
458	COMRd = `443`, // AVRInstrInfo.td:605
459	CPCRdRr = `444`, // AVRInstrInfo.td:726
460	CPIRdK = `445`, // AVRInstrInfo.td:742
461	CPRdRr = `446`, // AVRInstrInfo.td:712
462	CPSE = `447`, // AVRInstrInfo.td:709
463	DECRd = `448`, // AVRInstrInfo.td:483
464	DESK = `449`, // AVRInstrInfo.td:525
465	EICALL = `450`, // AVRInstrInfo.td:678
466	EIJMP = `451`, // AVRInstrInfo.td:652
467	ELPM = `452`, // AVRInstrInfo.td:1207
468	ELPMRdZ = `453`, // AVRInstrInfo.td:1210
469	ELPMRdZPi = `454`, // AVRInstrInfo.td:1215
470	EORRdRr = `455`, // AVRInstrInfo.td:560
471	FMUL = `456`, // AVRInstrInfo.td:509
472	FMULS = `457`, // AVRInstrInfo.td:513
473	FMULSU = `458`, // AVRInstrInfo.td:517
474	ICALL = `459`, // AVRInstrInfo.td:672
475	IJMP = `460`, // AVRInstrInfo.td:648
476	INCRd = `461`, // AVRInstrInfo.td:479
477	INRdA = `462`, // AVRInstrInfo.td:1258
478	JMPk = `463`, // AVRInstrInfo.td:655
479	LACZRd = `464`, // AVRInstrInfo.td:1304
480	LASZRd = `465`, // AVRInstrInfo.td:1301
481	LATZRd = `466`, // AVRInstrInfo.td:1307
482	LDDRdPtrQ = `467`, // AVRInstrInfo.td:954
483	LDIRdK = `468`, // AVRInstrInfo.td:866
484	LDRdPtr = `469`, // AVRInstrInfo.td:902
485	LDRdPtrPd = `470`, // AVRInstrInfo.td:938
486	LDRdPtrPi = `471`, // AVRInstrInfo.td:926
487	LDSRdK = `472`, // AVRInstrInfo.td:880
488	LDSRdKTiny = `473`, // AVRInstrInfo.td:885
489	LPM = `474`, // AVRInstrInfo.td:1174
490	LPMRdZ = `475`, // AVRInstrInfo.td:1187
491	LPMRdZPi = `476`, // AVRInstrInfo.td:1194
492	LSRRd = `477`, // AVRInstrInfo.td:1333
493	MOVRdRr = `478`, // AVRInstrInfo.td:856
494	MOVWRdRr = `479`, // AVRInstrInfo.td:859
495	MULRdRr = `480`, // AVRInstrInfo.td:496
496	MULSRdRr = `481`, // AVRInstrInfo.td:500
497	MULSURdRr = `482`, // AVRInstrInfo.td:505
498	NEGRd = `483`, // AVRInstrInfo.td:616
499	NOP = `484`, // AVRInstrInfo.td:1499
500	ORIRdK = `485`, // AVRInstrInfo.td:587
501	ORRdRr = `486`, // AVRInstrInfo.td:547
502	OUTARr = `487`, // AVRInstrInfo.td:1267
503	POPRd = `488`, // AVRInstrInfo.td:1288
504	PUSHRr = `489`, // AVRInstrInfo.td:1278
505	RCALLk = `490`, // AVRInstrInfo.td:666
506	RET = `491`, // AVRInstrInfo.td:697
507	RETI = `492`, // AVRInstrInfo.td:699
508	RJMPk = `493`, // AVRInstrInfo.td:645
509	RORRd = `494`, // AVRInstrInfo.td:1385
510	SBCIRdK = `495`, // AVRInstrInfo.td:462
511	SBCRdRr = `496`, // AVRInstrInfo.td:449
512	SBIAb = `497`, // AVRInstrInfo.td:1403
513	SBICAb = `498`, // AVRInstrInfo.td:759
514	SBISAb = `499`, // AVRInstrInfo.td:762
515	SBIWRdK = `500`, // AVRInstrInfo.td:442
516	SBRCRrB = `501`, // AVRInstrInfo.td:753
517	SBRSRrB = `502`, // AVRInstrInfo.td:756
518	SLEEP = `503`, // AVRInstrInfo.td:1506
519	SPM = `504`, // AVRInstrInfo.td:1246
520	SPMZPi = `505`, // AVRInstrInfo.td:1250
521	STDPtrQRr = `506`, // AVRInstrInfo.td:1150
522	STPtrPdRr = `507`, // AVRInstrInfo.td:1123
523	STPtrPiRr = `508`, // AVRInstrInfo.td:1098
524	STPtrRr = `509`, // AVRInstrInfo.td:1073
525	STSKRr = `510`, // AVRInstrInfo.td:1049
526	STSKRrTiny = `511`, // AVRInstrInfo.td:1054
527	SUBIRdK = `512`, // AVRInstrInfo.td:429
528	SUBRdRr = `513`, // AVRInstrInfo.td:415
529	SWAPRd = `514`, // AVRInstrInfo.td:1396
530	WDR = `515`, // AVRInstrInfo.td:1513
531	XCHZRd = `516`, // AVRInstrInfo.td:1298
532	INSTRUCTION_LIST_END = `517`
533	};
534
535	} // namespace llvm::AVR
536
537	#endif // GET_INSTRINFO_ENUM
538
539	#ifdef GET_INSTRINFO_SCHED_ENUM
540	#undef GET_INSTRINFO_SCHED_ENUM
541
542	namespace llvm::AVR::Sched {
543
544	enum {
545	NoInstrModel = `0`,
546	SCHED_LIST_END = `1`
547	};
548
549	} // namespace llvm::AVR::Sched
550
551	#endif // GET_INSTRINFO_SCHED_ENUM
552
553	#if defined(GET_INSTRINFO_MC_DESC) \|\| defined(GET_INSTRINFO_CTOR_DTOR)
554
555	namespace llvm {
556
557	struct AVRInstrTable {
558	MCInstrDesc Insts[`517`];
559	static_assert(alignof(MCInstrDesc) >= alignof(MCPhysReg), "Unwanted padding between Insts and ImplicitOps");
560	MCPhysReg ImplicitOps[`41`];
561	char Padding[sizeof(MCOperandInfo) - sizeof ImplicitOps % sizeof(MCOperandInfo)];
562	static_assert(alignof(MCInstrDesc) >= alignof(MCOperandInfo), "Unwanted padding between Insts and OperandInfo");
563	MCOperandInfo OperandInfo[`312`];
564	};
565	} // namespace llvm
566
567	#endif // defined(GET_INSTRINFO_MC_DESC) \|\| defined(GET_INSTRINFO_CTOR_DTOR)
568
569	#ifdef GET_INSTRINFO_MC_DESC
570	#undef GET_INSTRINFO_MC_DESC
571
572	namespace llvm {
573
574	static_assert((sizeof AVRInstrTable::ImplicitOps + sizeof AVRInstrTable::Padding) % sizeof(MCOperandInfo) == `0`);
575	static constexpr unsigned AVROpInfoBase = (sizeof AVRInstrTable::ImplicitOps + sizeof AVRInstrTable::Padding) / sizeof(MCOperandInfo);
576
577	extern const AVRInstrTable AVRDescs = {
578	{
579	{ `516`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `222`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // XCHZRd
580	{ `515`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // WDR
581	{ `514`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `237`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SWAPRd
582	{ `513`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `268`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SUBRdRr
583	{ `512`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `274`, `2`, `0`\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SUBIRdK
584	{ `511`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `310`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STSKRrTiny
585	{ `510`, `2`, `0`, `4`, `0`, `0`, `0`, AVROpInfoBase + `300`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STSKRr
586	{ `509`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `188`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STPtrRr
587	{ `508`, `4`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `306`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STPtrPiRr
588	{ `507`, `4`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `306`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STPtrPdRr
589	{ `506`, `3`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `303`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STDPtrQRr
590	{ `505`, `1`, `0`, `2`, `0`, `2`, `1`, AVROpInfoBase + `302`, `38`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SPMZPi
591	{ `504`, `0`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `1`, `9`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SPM
592	{ `503`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SLEEP
593	{ `502`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `282`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBRSRrB
594	{ `501`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `282`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBRCRrB
595	{ `500`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `271`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBIWRdK
596	{ `499`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `32`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBISAb
597	{ `498`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `32`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBICAb
598	{ `497`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `32`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBIAb
599	{ `496`, `3`, `1`, `2`, `0`, `1`, `1`, AVROpInfoBase + `268`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBCRdRr
600	{ `495`, `3`, `1`, `2`, `0`, `1`, `1`, AVROpInfoBase + `274`, `0`, `0`\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SBCIRdK
601	{ `494`, `2`, `1`, `2`, `0`, `1`, `1`, AVROpInfoBase + `237`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // RORRd
602	{ `493`, `1`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `0`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // RJMPk
603	{ `492`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Return)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // RETI
604	{ `491`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Return)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // RET
605	{ `490`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `16`, `0`\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // RCALLk
606	{ `489`, `1`, `0`, `2`, `0`, `1`, `1`, AVROpInfoBase + `192`, `10`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PUSHRr
607	{ `488`, `1`, `1`, `2`, `0`, `1`, `1`, AVROpInfoBase + `192`, `10`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // POPRd
608	{ `487`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `300`, `0`, `0`\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // OUTARr
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610	{ `485`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `274`, `2`, `0`\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ORIRdK
611	{ `484`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // NOP
612	{ `483`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `237`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // NEGRd
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616	{ `479`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `190`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // MOVWRdRr
617	{ `478`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `284`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // MOVRdRr
618	{ `477`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `237`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LSRRd
619	{ `476`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `222`, `9`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPMRdZPi
620	{ `475`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `222`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPMRdZ
621	{ `474`, `0`, `0`, `2`, `0`, `1`, `1`, AVROpInfoBase + `1`, `33`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPM
622	{ `473`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `286`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDSRdKTiny
623	{ `472`, `2`, `1`, `4`, `0`, `0`, `0`, AVROpInfoBase + `290`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDSRdK
624	{ `471`, `3`, `2`, `2`, `0`, `0`, `0`, AVROpInfoBase + `295`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDRdPtrPi
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627	{ `468`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `286`, `0`, `0`\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDIRdK
628	{ `467`, `3`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `292`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDDRdPtrQ
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630	{ `465`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `222`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LASZRd
631	{ `464`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `222`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LACZRd
632	{ `463`, `1`, `0`, `4`, `0`, `0`, `0`, AVROpInfoBase + `0`, `0`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // JMPk
633	{ `462`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `290`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // INRdA
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637	{ `458`, `2`, `0`, `2`, `0`, `0`, `3`, AVROpInfoBase + `288`, `35`, `0`\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // FMULSU
638	{ `457`, `2`, `0`, `2`, `0`, `0`, `3`, AVROpInfoBase + `288`, `35`, `0`\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // FMULS
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640	{ `455`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `268`, `2`, `0`\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // EORRdRr
641	{ `454`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `222`, `9`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMRdZPi
642	{ `453`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `222`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMRdZ
643	{ `452`, `0`, `0`, `2`, `0`, `1`, `1`, AVROpInfoBase + `1`, `33`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPM
644	{ `451`, `0`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `1`, `9`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::IndirectBranch)\|(`1ULL`<<MCID::Barrier)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // EIJMP
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647	{ `448`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `237`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // DECRd
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649	{ `446`, `2`, `0`, `2`, `0`, `0`, `1`, AVROpInfoBase + `284`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CPRdRr
650	{ `445`, `2`, `0`, `2`, `0`, `0`, `1`, AVROpInfoBase + `286`, `2`, `0`\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CPIRdK
651	{ `444`, `2`, `0`, `2`, `0`, `1`, `1`, AVROpInfoBase + `284`, `0`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CPCRdRr
652	{ `443`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `237`, `2`, `0`\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // COMRd
653	{ `442`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `32`, `0`, `0`\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CBIAb
654	{ `441`, `1`, `0`, `4`, `0`, `1`, `0`, AVROpInfoBase + `0`, `16`, `0`\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CALLk
655	{ `440`, `2`, `0`, `2`, `0`, `0`, `1`, AVROpInfoBase + `282`, `2`, `0`\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BST
656	{ `439`, `1`, `0`, `2`, `0`, `0`, `1`, AVROpInfoBase + `1`, `2`, `0`\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BSETs
657	{ `438`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BRSHk
658	{ `437`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BRPLk
659	{ `436`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BRNEk
660	{ `435`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BRMIk
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662	{ `433`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BRLOk
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664	{ `431`, `1`, `0`, `2`, `0`, `1`, `0`, AVROpInfoBase + `0`, `2`, `0`\|(`1ULL`<<MCID::Branch)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // BREQk
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718	{ `377`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `160`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LSLWRd
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722	{ `373`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `226`, `9`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPMWRdZPi
723	{ `372`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `224`, `8`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPMWRdZ
724	{ `371`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `222`, `8`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LPMBRdZ
725	{ `370`, `3`, `2`, `2`, `0`, `0`, `0`, AVROpInfoBase + `219`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDWRdPtrPi
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727	{ `368`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `217`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDWRdPtr
728	{ `367`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `215`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDSWRdK
729	{ `366`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `213`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LDIWRdK
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733	{ `362`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `202`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // FRMIDX
734	{ `361`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `151`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // EORWRdRr
735	{ `360`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `199`, `9`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMWRdZPi
736	{ `359`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `196`, `8`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMWRdZ
737	{ `358`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `193`, `9`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMBRdZPi
738	{ `357`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `193`, `8`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ELPMBRdZ
739	{ `356`, `1`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `192`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CopyZero
740	{ `355`, `2`, `0`, `2`, `0`, `0`, `1`, AVROpInfoBase + `190`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CPWRdRr
741	{ `354`, `2`, `0`, `2`, `0`, `1`, `1`, AVROpInfoBase + `190`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // CPCWRdRr
742	{ `353`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `160`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // COMWRd
743	{ `352`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `188`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicStore8
744	{ `351`, `2`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `186`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicStore16
745	{ `350`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `183`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadXor8
746	{ `349`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `180`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadXor16
747	{ `348`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `183`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadSub8
748	{ `347`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `180`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadSub16
749	{ `346`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `183`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadOr8
750	{ `345`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `180`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadOr16
751	{ `344`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `183`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadAnd8
752	{ `343`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `180`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadAnd16
753	{ `342`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `183`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadAdd8
754	{ `341`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `180`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoadAdd16
755	{ `340`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `178`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoad8
756	{ `339`, `2`, `1`, `2`, `0`, `0`, `0`, AVROpInfoBase + `176`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicLoad16
757	{ `338`, `0`, `0`, `2`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // AtomicFence
758	{ `337`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `173`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // Asr8
759	{ `336`, `5`, `2`, `2`, `0`, `0`, `1`, AVROpInfoBase + `168`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // Asr32
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762	{ `333`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `162`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ASRWNRd
763	{ `332`, `2`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `160`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ASRWLoRd
764	{ `331`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `157`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ASRBNRd
765	{ `330`, `3`, `1`, `2`, `0`, `0`, `1`, AVROpInfoBase + `151`, `2`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // ANDWRdRr
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793	{ `302`, `3`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `57`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_BZERO
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797	{ `298`, `4`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `143`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_MEMCPY
798	{ `297`, `2`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `141`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq)\|(`1ULL`<<MCID::Convergent), `0x0ULL` }, // G_WRITE_REGISTER
799	{ `296`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `50`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq)\|(`1ULL`<<MCID::Convergent), `0x0ULL` }, // G_READ_REGISTER
800	{ `295`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `100`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayRaiseFPException)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_STRICT_FLDEXP
801	{ `294`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `66`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayRaiseFPException)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_STRICT_FSQRT
802	{ `293`, `4`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `45`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayRaiseFPException)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_STRICT_FMA
803	{ `292`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `42`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayRaiseFPException)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_STRICT_FREM
804	{ `291`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `42`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayRaiseFPException)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_STRICT_FDIV
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812	{ `283`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `50`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_BLOCK_ADDR
813	{ `282`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `60`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ADDRSPACE_CAST
814	{ `281`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `66`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_FNEARBYINT
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857	{ `238`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `100`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_PTR_ADD
858	{ `237`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `49`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_SET_ROUNDING
859	{ `236`, `1`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `49`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_GET_ROUNDING
860	{ `235`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_RESET_FPMODE
861	{ `234`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `49`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_SET_FPMODE
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863	{ `232`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_RESET_FPENV
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930	{ `165`, `4`, `2`, `0`, `0`, `0`, `0`, AVROpInfoBase + `86`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Commutable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_UADDO
931	{ `164`, `4`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `86`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_SELECT
932	{ `163`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `111`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_UCMP
933	{ `162`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `111`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_SCMP
934	{ `161`, `4`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `107`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_FCMP
935	{ `160`, `4`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `107`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ICMP
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981	{ `114`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `90`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ATOMICRMW_OR
982	{ `113`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `90`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ATOMICRMW_NAND
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986	{ `109`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `90`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ATOMICRMW_XCHG
987	{ `108`, `4`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `86`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_ATOMIC_CMPXCHG
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989	{ `106`, `5`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `76`, `0`, `0`\|(`1ULL`<<MCID::PreISelOpcode)\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // G_INDEXED_STORE
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1054	{ `41`, `2`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `34`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // anonymous_14263
1055	{ `40`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Return)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHABLE_TAIL_CALL
1056	{ `39`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHABLE_FUNCTION_EXIT
1057	{ `38`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Return)\|(`1ULL`<<MCID::Terminator)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHABLE_RET
1058	{ `37`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHABLE_FUNCTION_ENTER
1059	{ `36`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHABLE_OP
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1062	{ `33`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STATEPOINT
1063	{ `32`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `29`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // anonymous_14262
1064	{ `31`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PREALLOCATED_SETUP
1065	{ `30`, `1`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `28`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::Rematerializable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // anonymous_13542
1066	{ `29`, `6`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `22`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PATCHPOINT
1067	{ `28`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::MayStore)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // FENTRY_CALL
1068	{ `27`, `2`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `20`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Call)\|(`1ULL`<<MCID::MayLoad)\|(`1ULL`<<MCID::UsesCustomInserter)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // STACKMAP
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1070	{ `25`, `4`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `14`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Meta)\|(`1ULL`<<MCID::UnmodeledSideEffects)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // PSEUDO_PROBE
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1072	{ `23`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Meta)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // LIFETIME_START
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1075	{ `20`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `9`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // COPY
1076	{ `19`, `2`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `9`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::CheapAsAMove)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // REG_SEQUENCE
1077	{ `18`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `0`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Meta)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // DBG_LABEL
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1080	{ `15`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Meta)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // DBG_VALUE_LIST
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1083	{ `12`, `3`, `1`, `0`, `0`, `0`, `0`, AVROpInfoBase + `2`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // SUBREG_TO_REG
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1091	{ `4`, `1`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Meta)\|(`1ULL`<<MCID::NotDuplicable)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // EH_LABEL
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1094	{ `1`, `0`, `0`, `0`, `0`, `0`, `0`, AVROpInfoBase + `1`, `0`, `0`\|(`1ULL`<<MCID::Pseudo)\|(`1ULL`<<MCID::Variadic)\|(`1ULL`<<MCID::ExtraSrcRegAllocReq)\|(`1ULL`<<MCID::ExtraDefRegAllocReq), `0x0ULL` }, // INLINEASM
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1097	/ 0 /
1098	/ 0 / AVR::SREG, AVR::SREG,
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1109	/ 33 / AVR::R31R30, AVR::R0,
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1113	`0`
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1120	/ 9 / { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
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1142	/ 71 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_2, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
1143	/ 76 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_2, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
1144	/ 81 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_2, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` },
1145	/ 86 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` },
1146	/ 90 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` },
1147	/ 93 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
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1152	/ 111 / { -`1`, `0`, MCOI::OPERAND_GENERIC_0, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` }, { -`1`, `0`, MCOI::OPERAND_GENERIC_1, `0` },
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1164	/ 154 / { AVR::DLDREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DLDREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1165	/ 157 / { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
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1169	/ 168 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
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1176	/ 188 / { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
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1178	/ 192 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
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1189	/ 219 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_EARLY_CLOBBER }, { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`1`) },
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1192	/ 226 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::ZREGRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1193	/ 228 / { AVR::DLDREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
1194	/ 231 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1195	/ 234 / { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1196	/ 236 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1197	/ 237 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) },
1198	/ 239 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1199	/ 241 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPRSPRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1200	/ 243 / { AVR::GPRSPRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1201	/ 245 / { AVR::GPRSPRegClassID, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::GPR8NOZRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1202	/ 248 / { AVR::PTRDISPREGSRegClassID, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1203	/ 251 / { AVR::GPRSPRegClassID, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::DREGSNOZRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
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1205	/ 256 / { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_EARLY_CLOBBER }, { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1206	/ 260 / { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::DREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1207	/ 264 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1208	/ 268 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1209	/ 271 / { AVR::IWREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::IWREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
1210	/ 274 / { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
1211	/ 277 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1212	/ 280 / { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` },
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1214	/ 284 / { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
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1220	/ 298 / { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1221	/ 300 / { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1222	/ 302 / { AVR::ZREGRegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1223	/ 303 / { AVR::PTRDISPREGSRegClassID, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1224	/ 306 / { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_EARLY_CLOBBER }, { AVR::PTRREGSRegClassID, `0`, MCOI::OPERAND_REGISTER, MCOI_TIED_TO(`0`) }, { AVR::GPR8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` }, { -`1`, `0`, MCOI::OPERAND_IMMEDIATE, `0` },
1225	/ 310 / { -`1`, `0`, MCOI::OPERAND_UNKNOWN, `0` }, { AVR::LD8RegClassID, `0`, MCOI::OPERAND_REGISTER, `0` },
1226	}
1227	};
1228
1229
1230	#ifdef __GNUC__
1231	#pragma GCC diagnostic push
1232	#pragma GCC diagnostic ignored "-Woverlength-strings"
1233	#endif
1234	extern const char AVRInstrNameData[] = {
1235	/ 0 / "G_FLOG10\000"
1236	/ 9 / "G_FEXP10\000"
1237	/ 18 / "ROLBRdR1\000"
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1239	/ 33 / "Asr32\000"
1240	/ 39 / "Lsr32\000"
1241	/ 45 / "G_FLOG2\000"
1242	/ 53 / "G_FATAN2\000"
1243	/ 62 / "G_FEXP2\000"
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1246	/ 99 / "AtomicLoadAdd16\000"
1247	/ 115 / "AtomicLoadAnd16\000"
1248	/ 131 / "AtomicStore16\000"
1249	/ 145 / "Rol16\000"
1250	/ 151 / "Lsl16\000"
1251	/ 157 / "AtomicLoadOr16\000"
1252	/ 172 / "Ror16\000"
1253	/ 178 / "AtomicLoadXor16\000"
1254	/ 194 / "Asr16\000"
1255	/ 200 / "Lsr16\000"
1256	/ 206 / "Select16\000"
1257	/ 215 / "ROLBRdR17\000"
1258	/ 225 / "AtomicLoadSub8\000"
1259	/ 240 / "AtomicLoad8\000"
1260	/ 252 / "AtomicLoadAdd8\000"
1261	/ 267 / "AtomicLoadAnd8\000"
1262	/ 282 / "AtomicStore8\000"
1263	/ 295 / "Rol8\000"
1264	/ 300 / "Lsl8\000"
1265	/ 305 / "AtomicLoadOr8\000"
1266	/ 319 / "Ror8\000"
1267	/ 324 / "AtomicLoadXor8\000"
1268	/ 339 / "Asr8\000"
1269	/ 344 / "Lsr8\000"
1270	/ 349 / "Select8\000"
1271	/ 357 / "G_FMA\000"
1272	/ 363 / "G_STRICT_FMA\000"
1273	/ 376 / "INRdA\000"
1274	/ 382 / "INWRdA\000"
1275	/ 389 / "G_FSUB\000"
1276	/ 396 / "G_STRICT_FSUB\000"
1277	/ 410 / "G_ATOMICRMW_FSUB\000"
1278	/ 427 / "G_SUB\000"
1279	/ 433 / "G_ATOMICRMW_SUB\000"
1280	/ 449 / "SBRCRrB\000"
1281	/ 457 / "SBRSRrB\000"
1282	/ 465 / "G_INTRINSIC\000"
1283	/ 477 / "G_FPTRUNC\000"
1284	/ 487 / "G_INTRINSIC_TRUNC\000"
1285	/ 505 / "G_TRUNC\000"
1286	/ 513 / "G_BUILD_VECTOR_TRUNC\000"
1287	/ 534 / "G_DYN_STACKALLOC\000"
1288	/ 551 / "SPREAD\000"
1289	/ 558 / "G_FMAD\000"
1290	/ 565 / "G_INDEXED_SEXTLOAD\000"
1291	/ 584 / "G_SEXTLOAD\000"
1292	/ 595 / "G_INDEXED_ZEXTLOAD\000"
1293	/ 614 / "G_ZEXTLOAD\000"
1294	/ 625 / "G_INDEXED_LOAD\000"
1295	/ 640 / "G_LOAD\000"
1296	/ 647 / "G_VECREDUCE_FADD\000"
1297	/ 664 / "G_FADD\000"
1298	/ 671 / "G_VECREDUCE_SEQ_FADD\000"
1299	/ 692 / "G_STRICT_FADD\000"
1300	/ 706 / "G_ATOMICRMW_FADD\000"
1301	/ 723 / "G_VECREDUCE_ADD\000"
1302	/ 739 / "G_ADD\000"
1303	/ 745 / "G_PTR_ADD\000"
1304	/ 755 / "G_ATOMICRMW_ADD\000"
1305	/ 771 / "BLD\000"
1306	/ 775 / "G_ATOMICRMW_NAND\000"
1307	/ 792 / "G_VECREDUCE_AND\000"
1308	/ 808 / "G_AND\000"
1309	/ 814 / "G_ATOMICRMW_AND\000"
1310	/ 830 / "LIFETIME_END\000"
1311	/ 843 / "G_BRCOND\000"
1312	/ 852 / "G_ATOMICRMW_USUB_COND\000"
1313	/ 874 / "G_LLROUND\000"
1314	/ 884 / "G_LROUND\000"
1315	/ 893 / "G_INTRINSIC_ROUND\000"
1316	/ 911 / "G_INTRINSIC_FPTRUNC_ROUND\000"
1317	/ 937 / "LOAD_STACK_GUARD\000"
1318	/ 954 / "PSEUDO_PROBE\000"
1319	/ 967 / "G_SSUBE\000"
1320	/ 975 / "G_USUBE\000"
1321	/ 983 / "G_FENCE\000"
1322	/ 991 / "ARITH_FENCE\000"
1323	/ 1003 / "REG_SEQUENCE\000"
1324	/ 1016 / "G_SADDE\000"
1325	/ 1024 / "G_UADDE\000"
1326	/ 1032 / "G_GET_FPMODE\000"
1327	/ 1045 / "G_RESET_FPMODE\000"
1328	/ 1060 / "G_SET_FPMODE\000"
1329	/ 1073 / "G_FMINNUM_IEEE\000"
1330	/ 1088 / "G_FMAXNUM_IEEE\000"
1331	/ 1103 / "G_VSCALE\000"
1332	/ 1112 / "G_JUMP_TABLE\000"
1333	/ 1125 / "BUNDLE\000"
1334	/ 1132 / "G_MEMCPY_INLINE\000"
1335	/ 1148 / "RELOC_NONE\000"
1336	/ 1159 / "LOCAL_ESCAPE\000"
1337	/ 1172 / "G_STACKRESTORE\000"
1338	/ 1187 / "G_INDEXED_STORE\000"
1339	/ 1203 / "G_STORE\000"
1340	/ 1211 / "CPSE\000"
1341	/ 1216 / "G_BITREVERSE\000"
1342	/ 1229 / "FAKE_USE\000"
1343	/ 1238 / "SPWRITE\000"
1344	/ 1246 / "DBG_VALUE\000"
1345	/ 1256 / "G_GLOBAL_VALUE\000"
1346	/ 1271 / "G_PTRAUTH_GLOBAL_VALUE\000"
1347	/ 1294 / "CONVERGENCECTRL_GLUE\000"
1348	/ 1315 / "G_STACKSAVE\000"
1349	/ 1327 / "G_MEMMOVE\000"
1350	/ 1337 / "G_FREEZE\000"
1351	/ 1346 / "G_FCANONICALIZE\000"
1352	/ 1362 / "G_FMODF\000"
1353	/ 1370 / "G_CTLZ_ZERO_UNDEF\000"
1354	/ 1388 / "G_CTTZ_ZERO_UNDEF\000"
1355	/ 1406 / "INIT_UNDEF\000"
1356	/ 1417 / "G_IMPLICIT_DEF\000"
1357	/ 1432 / "DBG_INSTR_REF\000"
1358	/ 1446 / "G_FNEG\000"
1359	/ 1453 / "EXTRACT_SUBREG\000"
1360	/ 1468 / "INSERT_SUBREG\000"
1361	/ 1482 / "G_SEXT_INREG\000"
1362	/ 1495 / "SUBREG_TO_REG\000"
1363	/ 1509 / "G_ATOMIC_CMPXCHG\000"
1364	/ 1526 / "G_ATOMICRMW_XCHG\000"
1365	/ 1543 / "G_GET_ROUNDING\000"
1366	/ 1558 / "G_SET_ROUNDING\000"
1367	/ 1573 / "G_FLOG\000"
1368	/ 1580 / "G_VAARG\000"
1369	/ 1588 / "PREALLOCATED_ARG\000"
1370	/ 1605 / "G_PREFETCH\000"
1371	/ 1616 / "G_SMULH\000"
1372	/ 1624 / "G_UMULH\000"
1373	/ 1632 / "G_FTANH\000"
1374	/ 1640 / "G_FSINH\000"
1375	/ 1648 / "G_FCOSH\000"
1376	/ 1656 / "DBG_PHI\000"
1377	/ 1664 / "G_FPTOSI\000"
1378	/ 1673 / "RETI\000"
1379	/ 1678 / "G_FPTOUI\000"
1380	/ 1687 / "G_FPOWI\000"
1381	/ 1695 / "BREAK\000"
1382	/ 1701 / "COPY_LANEMASK\000"
1383	/ 1715 / "G_PTRMASK\000"
1384	/ 1725 / "DESK\000"
1385	/ 1730 / "SUBIRdK\000"
1386	/ 1738 / "SBCIRdK\000"
1387	/ 1746 / "LDIRdK\000"
1388	/ 1753 / "ANDIRdK\000"
1389	/ 1761 / "CPIRdK\000"
1390	/ 1768 / "ORIRdK\000"
1391	/ 1775 / "LDSRdK\000"
1392	/ 1782 / "SBIWRdK\000"
1393	/ 1790 / "SUBIWRdK\000"
1394	/ 1799 / "SBCIWRdK\000"
1395	/ 1808 / "ADIWRdK\000"
1396	/ 1816 / "LDIWRdK\000"
1397	/ 1824 / "ANDIWRdK\000"
1398	/ 1833 / "ORIWRdK\000"
1399	/ 1841 / "LDSWRdK\000"
1400	/ 1849 / "GC_LABEL\000"
1401	/ 1858 / "DBG_LABEL\000"
1402	/ 1868 / "EH_LABEL\000"
1403	/ 1877 / "ANNOTATION_LABEL\000"
1404	/ 1894 / "ICALL_BRANCH_FUNNEL\000"
1405	/ 1914 / "G_FSHL\000"
1406	/ 1921 / "G_SHL\000"
1407	/ 1927 / "G_FCEIL\000"
1408	/ 1935 / "G_SAVGCEIL\000"
1409	/ 1946 / "G_UAVGCEIL\000"
1410	/ 1957 / "EICALL\000"
1411	/ 1964 / "PATCHABLE_TAIL_CALL\000"
1412	/ 1984 / "PATCHABLE_TYPED_EVENT_CALL\000"
1413	/ 2011 / "PATCHABLE_EVENT_CALL\000"
1414	/ 2032 / "FENTRY_CALL\000"
1415	/ 2044 / "KILL\000"
1416	/ 2049 / "G_CONSTANT_POOL\000"
1417	/ 2065 / "G_ROTL\000"
1418	/ 2072 / "G_VECREDUCE_FMUL\000"
1419	/ 2089 / "G_FMUL\000"
1420	/ 2096 / "G_VECREDUCE_SEQ_FMUL\000"
1421	/ 2117 / "G_STRICT_FMUL\000"
1422	/ 2131 / "G_VECREDUCE_MUL\000"
1423	/ 2147 / "G_MUL\000"
1424	/ 2153 / "G_FREM\000"
1425	/ 2160 / "G_STRICT_FREM\000"
1426	/ 2174 / "G_SREM\000"
1427	/ 2181 / "G_UREM\000"
1428	/ 2188 / "G_SDIVREM\000"
1429	/ 2198 / "G_UDIVREM\000"
1430	/ 2208 / "ELPM\000"
1431	/ 2213 / "SPM\000"
1432	/ 2217 / "INLINEASM\000"
1433	/ 2227 / "G_VECREDUCE_FMINIMUM\000"
1434	/ 2248 / "G_FMINIMUM\000"
1435	/ 2259 / "G_ATOMICRMW_FMINIMUM\000"
1436	/ 2280 / "G_VECREDUCE_FMAXIMUM\000"
1437	/ 2301 / "G_FMAXIMUM\000"
1438	/ 2312 / "G_ATOMICRMW_FMAXIMUM\000"
1439	/ 2333 / "G_FMINIMUMNUM\000"
1440	/ 2347 / "G_ATOMICRMW_FMINIMUMNUM\000"
1441	/ 2371 / "G_FMAXIMUMNUM\000"
1442	/ 2385 / "G_ATOMICRMW_FMAXIMUMNUM\000"
1443	/ 2409 / "G_FMINNUM\000"
1444	/ 2419 / "G_FMAXNUM\000"
1445	/ 2429 / "G_FATAN\000"
1446	/ 2437 / "G_FTAN\000"
1447	/ 2444 / "G_INTRINSIC_ROUNDEVEN\000"
1448	/ 2466 / "G_ASSERT_ALIGN\000"
1449	/ 2481 / "G_FCOPYSIGN\000"
1450	/ 2493 / "G_VECREDUCE_FMIN\000"
1451	/ 2510 / "G_ATOMICRMW_FMIN\000"
1452	/ 2527 / "G_VECREDUCE_SMIN\000"
1453	/ 2544 / "G_SMIN\000"
1454	/ 2551 / "G_VECREDUCE_UMIN\000"
1455	/ 2568 / "G_UMIN\000"
1456	/ 2575 / "G_ATOMICRMW_UMIN\000"
1457	/ 2592 / "G_ATOMICRMW_MIN\000"
1458	/ 2608 / "G_FASIN\000"
1459	/ 2616 / "G_FSIN\000"
1460	/ 2623 / "CFI_INSTRUCTION\000"
1461	/ 2639 / "ADJCALLSTACKDOWN\000"
1462	/ 2656 / "G_SSUBO\000"
1463	/ 2664 / "G_USUBO\000"
1464	/ 2672 / "G_SADDO\000"
1465	/ 2680 / "G_UADDO\000"
1466	/ 2688 / "JUMP_TABLE_DEBUG_INFO\000"
1467	/ 2710 / "G_SMULO\000"
1468	/ 2718 / "G_UMULO\000"
1469	/ 2726 / "G_BZERO\000"
1470	/ 2734 / "STACKMAP\000"
1471	/ 2743 / "G_DEBUGTRAP\000"
1472	/ 2755 / "G_UBSANTRAP\000"
1473	/ 2767 / "G_TRAP\000"
1474	/ 2774 / "G_ATOMICRMW_UDEC_WRAP\000"
1475	/ 2796 / "G_ATOMICRMW_UINC_WRAP\000"
1476	/ 2818 / "G_BSWAP\000"
1477	/ 2826 / "SLEEP\000"
1478	/ 2832 / "G_SITOFP\000"
1479	/ 2841 / "G_UITOFP\000"
1480	/ 2850 / "G_FCMP\000"
1481	/ 2857 / "G_ICMP\000"
1482	/ 2864 / "G_SCMP\000"
1483	/ 2871 / "G_UCMP\000"
1484	/ 2878 / "EIJMP\000"
1485	/ 2884 / "NOP\000"
1486	/ 2888 / "CONVERGENCECTRL_LOOP\000"
1487	/ 2909 / "G_CTPOP\000"
1488	/ 2917 / "PATCHABLE_OP\000"
1489	/ 2930 / "FAULTING_OP\000"
1490	/ 2942 / "ADJCALLSTACKUP\000"
1491	/ 2957 / "PREALLOCATED_SETUP\000"
1492	/ 2976 / "G_FLDEXP\000"
1493	/ 2985 / "G_STRICT_FLDEXP\000"
1494	/ 3001 / "G_FEXP\000"
1495	/ 3008 / "G_FFREXP\000"
1496	/ 3017 / "LDDWRdYQ\000"
1497	/ 3026 / "LDDRdPtrQ\000"
1498	/ 3036 / "LDDWRdPtrQ\000"
1499	/ 3047 / "G_BR\000"
1500	/ 3052 / "INLINEASM_BR\000"
1501	/ 3065 / "G_BLOCK_ADDR\000"
1502	/ 3078 / "WDR\000"
1503	/ 3082 / "MEMBARRIER\000"
1504	/ 3093 / "G_CONSTANT_FOLD_BARRIER\000"
1505	/ 3117 / "PATCHABLE_FUNCTION_ENTER\000"
1506	/ 3142 / "G_READCYCLECOUNTER\000"
1507	/ 3161 / "G_READSTEADYCOUNTER\000"
1508	/ 3181 / "G_READ_REGISTER\000"
1509	/ 3197 / "G_WRITE_REGISTER\000"
1510	/ 3214 / "G_ASHR\000"
1511	/ 3221 / "G_FSHR\000"
1512	/ 3228 / "G_LSHR\000"
1513	/ 3235 / "CONVERGENCECTRL_ANCHOR\000"
1514	/ 3258 / "G_FFLOOR\000"
1515	/ 3267 / "G_SAVGFLOOR\000"
1516	/ 3279 / "G_UAVGFLOOR\000"
1517	/ 3291 / "G_EXTRACT_SUBVECTOR\000"
1518	/ 3311 / "G_INSERT_SUBVECTOR\000"
1519	/ 3330 / "G_BUILD_VECTOR\000"
1520	/ 3345 / "G_SHUFFLE_VECTOR\000"
1521	/ 3362 / "G_STEP_VECTOR\000"
1522	/ 3376 / "G_SPLAT_VECTOR\000"
1523	/ 3391 / "G_VECREDUCE_XOR\000"
1524	/ 3407 / "G_XOR\000"
1525	/ 3413 / "G_ATOMICRMW_XOR\000"
1526	/ 3429 / "G_VECREDUCE_OR\000"
1527	/ 3444 / "G_OR\000"
1528	/ 3449 / "G_ATOMICRMW_OR\000"
1529	/ 3464 / "G_ROTR\000"
1530	/ 3471 / "G_INTTOPTR\000"
1531	/ 3482 / "G_FABS\000"
1532	/ 3489 / "G_ABS\000"
1533	/ 3495 / "G_ABDS\000"
1534	/ 3502 / "G_UNMERGE_VALUES\000"
1535	/ 3519 / "G_MERGE_VALUES\000"
1536	/ 3534 / "G_CTLS\000"
1537	/ 3541 / "FMULS\000"
1538	/ 3547 / "G_FACOS\000"
1539	/ 3555 / "G_FCOS\000"
1540	/ 3562 / "G_FSINCOS\000"
1541	/ 3572 / "G_CONCAT_VECTORS\000"
1542	/ 3589 / "COPY_TO_REGCLASS\000"
1543	/ 3606 / "G_IS_FPCLASS\000"
1544	/ 3619 / "G_ATOMIC_CMPXCHG_WITH_SUCCESS\000"
1545	/ 3649 / "G_VECTOR_COMPRESS\000"
1546	/ 3667 / "G_INTRINSIC_W_SIDE_EFFECTS\000"
1547	/ 3694 / "G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS\000"
1548	/ 3732 / "G_TRUNC_SSAT_S\000"
1549	/ 3747 / "G_SSUBSAT\000"
1550	/ 3757 / "G_USUBSAT\000"
1551	/ 3767 / "G_SADDSAT\000"
1552	/ 3777 / "G_UADDSAT\000"
1553	/ 3787 / "G_SSHLSAT\000"
1554	/ 3797 / "G_USHLSAT\000"
1555	/ 3807 / "G_SMULFIXSAT\000"
1556	/ 3820 / "G_UMULFIXSAT\000"
1557	/ 3833 / "G_SDIVFIXSAT\000"
1558	/ 3846 / "G_UDIVFIXSAT\000"
1559	/ 3859 / "G_ATOMICRMW_USUB_SAT\000"
1560	/ 3880 / "G_FPTOSI_SAT\000"
1561	/ 3893 / "G_FPTOUI_SAT\000"
1562	/ 3906 / "G_EXTRACT\000"
1563	/ 3916 / "G_SELECT\000"
1564	/ 3925 / "G_BRINDIRECT\000"
1565	/ 3938 / "PATCHABLE_RET\000"
1566	/ 3952 / "G_MEMSET\000"
1567	/ 3961 / "PATCHABLE_FUNCTION_EXIT\000"
1568	/ 3985 / "G_BRJT\000"
1569	/ 3992 / "G_EXTRACT_VECTOR_ELT\000"
1570	/ 4013 / "G_INSERT_VECTOR_ELT\000"
1571	/ 4033 / "G_FCONSTANT\000"
1572	/ 4045 / "G_CONSTANT\000"
1573	/ 4056 / "G_INTRINSIC_CONVERGENT\000"
1574	/ 4079 / "STATEPOINT\000"
1575	/ 4090 / "PATCHPOINT\000"
1576	/ 4101 / "G_PTRTOINT\000"
1577	/ 4112 / "G_FRINT\000"
1578	/ 4120 / "G_INTRINSIC_LLRINT\000"
1579	/ 4139 / "G_INTRINSIC_LRINT\000"
1580	/ 4157 / "G_FNEARBYINT\000"
1581	/ 4170 / "G_VASTART\000"
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1733	};
1734	#ifdef __GNUC__
1735	#pragma GCC diagnostic pop
1736	#endif
1737
1738	extern const unsigned AVRInstrNameIndices[] = {
1739	`1660U`, `2217U`, `3052U`, `2623U`, `1868U`, `1849U`, `1877U`, `2044U`,
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1804	};
1805
1806	static inline void InitAVRMCInstrInfo(MCInstrInfo *II) {
1807	II->InitMCInstrInfo(AVRDescs.Insts, AVRInstrNameIndices, AVRInstrNameData, nullptr, nullptr, `517`, nullptr, `0`);
1808	}
1809
1810
1811	} // namespace llvm
1812
1813	#endif // GET_INSTRINFO_MC_DESC
1814
1815	#ifdef GET_INSTRINFO_HEADER
1816	#undef GET_INSTRINFO_HEADER
1817
1818	namespace llvm {
1819
1820	struct AVRGenInstrInfo : public TargetInstrInfo {
1821	explicit AVRGenInstrInfo(const TargetSubtargetInfo &STI, const TargetRegisterInfo &TRI, unsigned CFSetupOpcode = ~`0u`, unsigned CFDestroyOpcode = ~`0u`, unsigned CatchRetOpcode = ~`0u`, unsigned ReturnOpcode = ~`0u`);
1822	~AVRGenInstrInfo() override = default;
1823	};
1824
1825	} // namespace llvm
1826
1827	namespace llvm::AVR {
1828
1829
1830	} // namespace llvm::AVR
1831
1832	#endif // GET_INSTRINFO_HEADER
1833
1834	#ifdef GET_INSTRINFO_HELPER_DECLS
1835	#undef GET_INSTRINFO_HELPER_DECLS
1836
1837
1838	#endif // GET_INSTRINFO_HELPER_DECLS
1839
1840	#ifdef GET_INSTRINFO_HELPERS
1841	#undef GET_INSTRINFO_HELPERS
1842
1843
1844	#endif // GET_INSTRINFO_HELPERS
1845
1846	#ifdef GET_INSTRINFO_CTOR_DTOR
1847	#undef GET_INSTRINFO_CTOR_DTOR
1848
1849	namespace llvm {
1850
1851	extern const AVRInstrTable AVRDescs;
1852	extern const unsigned AVRInstrNameIndices[];
1853	extern const char AVRInstrNameData[];
1854	AVRGenInstrInfo::AVRGenInstrInfo(const TargetSubtargetInfo &STI, const TargetRegisterInfo &TRI, unsigned CFSetupOpcode, unsigned CFDestroyOpcode, unsigned CatchRetOpcode, unsigned ReturnOpcode)
1855	: TargetInstrInfo(TRI, CFSetupOpcode, CFDestroyOpcode, CatchRetOpcode, ReturnOpcode) {
1856	InitMCInstrInfo(AVRDescs.Insts, AVRInstrNameIndices, AVRInstrNameData, nullptr, nullptr, `517`);
1857	}
1858
1859	} // namespace llvm
1860
1861	#endif // GET_INSTRINFO_CTOR_DTOR
1862
1863	#ifdef GET_INSTRINFO_MC_HELPER_DECLS
1864	#undef GET_INSTRINFO_MC_HELPER_DECLS
1865
1866	namespace llvm {
1867
1868	class MCInst;
1869	class FeatureBitset;
1870
1871	namespace AVR_MC {
1872
1873	void verifyInstructionPredicates(unsigned Opcode, const FeatureBitset &Features);
1874
1875	} // namespace AVR_MC
1876
1877	} // namespace llvm
1878
1879	#endif // GET_INSTRINFO_MC_HELPER_DECLS
1880
1881	#ifdef GET_INSTRINFO_MC_HELPERS
1882	#undef GET_INSTRINFO_MC_HELPERS
1883
1884	namespace llvm::AVR_MC {
1885
1886
1887	} // namespace llvm::AVR_MC
1888
1889	#endif // GET_INSTRINFO_MC_HELPERS
1890
1891	#if (defined(ENABLE_INSTR_PREDICATE_VERIFIER) && !defined(NDEBUG)) \|\|\
1892	defined(GET_AVAILABLE_OPCODE_CHECKER)
1893	#define GET_COMPUTE_FEATURES
1894	#endif
1895	#ifdef GET_COMPUTE_FEATURES
1896	#undef GET_COMPUTE_FEATURES
1897
1898	namespace llvm::AVR_MC {
1899
1900	// Bits for subtarget features that participate in instruction matching.
1901	enum SubtargetFeatureBits : uint8_t {
1902	Feature_HasSRAMBit = `14`,
1903	Feature_HasJMPCALLBit = `7`,
1904	Feature_HasIJMPCALLBit = `6`,
1905	Feature_HasEIJMPCALLBit = `3`,
1906	Feature_HasADDSUBIWBit = `0`,
1907	Feature_HasSmallStackBit = `15`,
1908	Feature_HasMOVWBit = `10`,
1909	Feature_HasLPMBit = `8`,
1910	Feature_HasLPMXBit = `9`,
1911	Feature_HasELPMBit = `4`,
1912	Feature_HasELPMXBit = `5`,
1913	Feature_HasSPMBit = `12`,
1914	Feature_HasSPMXBit = `13`,
1915	Feature_HasDESBit = `2`,
1916	Feature_SupportsRMWBit = `18`,
1917	Feature_SupportsMultiplicationBit = `17`,
1918	Feature_HasBREAKBit = `1`,
1919	Feature_HasTinyEncodingBit = `16`,
1920	Feature_HasNonTinyEncodingBit = `11`,
1921	};
1922
1923	inline FeatureBitset computeAvailableFeatures(const FeatureBitset &FB) {
1924	FeatureBitset Features;
1925	if (FB[AVR::FeatureSRAM])
1926	Features.set(Feature_HasSRAMBit);
1927	if (FB[AVR::FeatureJMPCALL])
1928	Features.set(Feature_HasJMPCALLBit);
1929	if (FB[AVR::FeatureIJMPCALL])
1930	Features.set(Feature_HasIJMPCALLBit);
1931	if (FB[AVR::FeatureEIJMPCALL])
1932	Features.set(Feature_HasEIJMPCALLBit);
1933	if (FB[AVR::FeatureADDSUBIW])
1934	Features.set(Feature_HasADDSUBIWBit);
1935	if (FB[AVR::FeatureSmallStack])
1936	Features.set(Feature_HasSmallStackBit);
1937	if (FB[AVR::FeatureMOVW])
1938	Features.set(Feature_HasMOVWBit);
1939	if (FB[AVR::FeatureLPM])
1940	Features.set(Feature_HasLPMBit);
1941	if (FB[AVR::FeatureLPMX])
1942	Features.set(Feature_HasLPMXBit);
1943	if (FB[AVR::FeatureELPM])
1944	Features.set(Feature_HasELPMBit);
1945	if (FB[AVR::FeatureELPMX])
1946	Features.set(Feature_HasELPMXBit);
1947	if (FB[AVR::FeatureSPM])
1948	Features.set(Feature_HasSPMBit);
1949	if (FB[AVR::FeatureSPMX])
1950	Features.set(Feature_HasSPMXBit);
1951	if (FB[AVR::FeatureDES])
1952	Features.set(Feature_HasDESBit);
1953	if (FB[AVR::FeatureRMW])
1954	Features.set(Feature_SupportsRMWBit);
1955	if (FB[AVR::FeatureMultiplication])
1956	Features.set(Feature_SupportsMultiplicationBit);
1957	if (FB[AVR::FeatureBREAK])
1958	Features.set(Feature_HasBREAKBit);
1959	if (FB[AVR::FeatureTinyEncoding])
1960	Features.set(Feature_HasTinyEncodingBit);
1961	if (!FB[AVR::FeatureTinyEncoding])
1962	Features.set(Feature_HasNonTinyEncodingBit);
1963	return Features;
1964	}
1965
1966	inline FeatureBitset computeRequiredFeatures(unsigned Opcode) {
1967	enum : uint8_t {
1968	CEFBS_None,
1969	CEFBS_HasADDSUBIW,
1970	CEFBS_HasBREAK,
1971	CEFBS_HasDES,
1972	CEFBS_HasEIJMPCALL,
1973	CEFBS_HasELPM,
1974	CEFBS_HasELPMX,
1975	CEFBS_HasIJMPCALL,
1976	CEFBS_HasJMPCALL,
1977	CEFBS_HasLPM,
1978	CEFBS_HasLPMX,
1979	CEFBS_HasMOVW,
1980	CEFBS_HasNonTinyEncoding,
1981	CEFBS_HasSPM,
1982	CEFBS_HasSPMX,
1983	CEFBS_HasSRAM,
1984	CEFBS_HasTinyEncoding,
1985	CEFBS_SupportsMultiplication,
1986	CEFBS_SupportsRMW,
1987	CEFBS_HasSRAM_HasNonTinyEncoding,
1988	CEFBS_HasSRAM_HasTinyEncoding,
1989	};
1990
1991	static constexpr FeatureBitset FeatureBitsets[] = {
1992	{}, // CEFBS_None
1993	{Feature_HasADDSUBIWBit, },
1994	{Feature_HasBREAKBit, },
1995	{Feature_HasDESBit, },
1996	{Feature_HasEIJMPCALLBit, },
1997	{Feature_HasELPMBit, },
1998	{Feature_HasELPMXBit, },
1999	{Feature_HasIJMPCALLBit, },
2000	{Feature_HasJMPCALLBit, },
2001	{Feature_HasLPMBit, },
2002	{Feature_HasLPMXBit, },
2003	{Feature_HasMOVWBit, },
2004	{Feature_HasNonTinyEncodingBit, },
2005	{Feature_HasSPMBit, },
2006	{Feature_HasSPMXBit, },
2007	{Feature_HasSRAMBit, },
2008	{Feature_HasTinyEncodingBit, },
2009	{Feature_SupportsMultiplicationBit, },
2010	{Feature_SupportsRMWBit, },
2011	{Feature_HasSRAMBit, Feature_HasNonTinyEncodingBit, },
2012	{Feature_HasSRAMBit, Feature_HasTinyEncodingBit, },
2013	};
2014	static constexpr uint8_t RequiredFeaturesRefs[] = {
2015	CEFBS_None, // PHI
2016	CEFBS_None, // INLINEASM
2017	CEFBS_None, // INLINEASM_BR
2018	CEFBS_None, // CFI_INSTRUCTION
2019	CEFBS_None, // EH_LABEL
2020	CEFBS_None, // GC_LABEL
2021	CEFBS_None, // ANNOTATION_LABEL
2022	CEFBS_None, // KILL
2023	CEFBS_None, // EXTRACT_SUBREG
2024	CEFBS_None, // INSERT_SUBREG
2025	CEFBS_None, // IMPLICIT_DEF
2026	CEFBS_None, // INIT_UNDEF
2027	CEFBS_None, // SUBREG_TO_REG
2028	CEFBS_None, // COPY_TO_REGCLASS
2029	CEFBS_None, // DBG_VALUE
2030	CEFBS_None, // DBG_VALUE_LIST
2031	CEFBS_None, // DBG_INSTR_REF
2032	CEFBS_None, // DBG_PHI
2033	CEFBS_None, // DBG_LABEL
2034	CEFBS_None, // REG_SEQUENCE
2035	CEFBS_None, // COPY
2036	CEFBS_None, // COPY_LANEMASK
2037	CEFBS_None, // BUNDLE
2038	CEFBS_None, // LIFETIME_START
2039	CEFBS_None, // LIFETIME_END
2040	CEFBS_None, // PSEUDO_PROBE
2041	CEFBS_None, // ARITH_FENCE
2042	CEFBS_None, // STACKMAP
2043	CEFBS_None, // FENTRY_CALL
2044	CEFBS_None, // PATCHPOINT
2045	CEFBS_None, // LOAD_STACK_GUARD
2046	CEFBS_None, // PREALLOCATED_SETUP
2047	CEFBS_None, // PREALLOCATED_ARG
2048	CEFBS_None, // STATEPOINT
2049	CEFBS_None, // LOCAL_ESCAPE
2050	CEFBS_None, // FAULTING_OP
2051	CEFBS_None, // PATCHABLE_OP
2052	CEFBS_None, // PATCHABLE_FUNCTION_ENTER
2053	CEFBS_None, // PATCHABLE_RET
2054	CEFBS_None, // PATCHABLE_FUNCTION_EXIT
2055	CEFBS_None, // PATCHABLE_TAIL_CALL
2056	CEFBS_None, // PATCHABLE_EVENT_CALL
2057	CEFBS_None, // PATCHABLE_TYPED_EVENT_CALL
2058	CEFBS_None, // ICALL_BRANCH_FUNNEL
2059	CEFBS_None, // FAKE_USE
2060	CEFBS_None, // MEMBARRIER
2061	CEFBS_None, // JUMP_TABLE_DEBUG_INFO
2062	CEFBS_None, // RELOC_NONE
2063	CEFBS_None, // CONVERGENCECTRL_ENTRY
2064	CEFBS_None, // CONVERGENCECTRL_ANCHOR
2065	CEFBS_None, // CONVERGENCECTRL_LOOP
2066	CEFBS_None, // CONVERGENCECTRL_GLUE
2067	CEFBS_None, // G_ASSERT_SEXT
2068	CEFBS_None, // G_ASSERT_ZEXT
2069	CEFBS_None, // G_ASSERT_ALIGN
2070	CEFBS_None, // G_ADD
2071	CEFBS_None, // G_SUB
2072	CEFBS_None, // G_MUL
2073	CEFBS_None, // G_SDIV
2074	CEFBS_None, // G_UDIV
2075	CEFBS_None, // G_SREM
2076	CEFBS_None, // G_UREM
2077	CEFBS_None, // G_SDIVREM
2078	CEFBS_None, // G_UDIVREM
2079	CEFBS_None, // G_AND
2080	CEFBS_None, // G_OR
2081	CEFBS_None, // G_XOR
2082	CEFBS_None, // G_ABDS
2083	CEFBS_None, // G_ABDU
2084	CEFBS_None, // G_UAVGFLOOR
2085	CEFBS_None, // G_UAVGCEIL
2086	CEFBS_None, // G_SAVGFLOOR
2087	CEFBS_None, // G_SAVGCEIL
2088	CEFBS_None, // G_IMPLICIT_DEF
2089	CEFBS_None, // G_PHI
2090	CEFBS_None, // G_FRAME_INDEX
2091	CEFBS_None, // G_GLOBAL_VALUE
2092	CEFBS_None, // G_PTRAUTH_GLOBAL_VALUE
2093	CEFBS_None, // G_CONSTANT_POOL
2094	CEFBS_None, // G_EXTRACT
2095	CEFBS_None, // G_UNMERGE_VALUES
2096	CEFBS_None, // G_INSERT
2097	CEFBS_None, // G_MERGE_VALUES
2098	CEFBS_None, // G_BUILD_VECTOR
2099	CEFBS_None, // G_BUILD_VECTOR_TRUNC
2100	CEFBS_None, // G_CONCAT_VECTORS
2101	CEFBS_None, // G_PTRTOINT
2102	CEFBS_None, // G_INTTOPTR
2103	CEFBS_None, // G_BITCAST
2104	CEFBS_None, // G_FREEZE
2105	CEFBS_None, // G_CONSTANT_FOLD_BARRIER
2106	CEFBS_None, // G_INTRINSIC_FPTRUNC_ROUND
2107	CEFBS_None, // G_INTRINSIC_TRUNC
2108	CEFBS_None, // G_INTRINSIC_ROUND
2109	CEFBS_None, // G_INTRINSIC_LRINT
2110	CEFBS_None, // G_INTRINSIC_LLRINT
2111	CEFBS_None, // G_INTRINSIC_ROUNDEVEN
2112	CEFBS_None, // G_READCYCLECOUNTER
2113	CEFBS_None, // G_READSTEADYCOUNTER
2114	CEFBS_None, // G_LOAD
2115	CEFBS_None, // G_SEXTLOAD
2116	CEFBS_None, // G_ZEXTLOAD
2117	CEFBS_None, // G_INDEXED_LOAD
2118	CEFBS_None, // G_INDEXED_SEXTLOAD
2119	CEFBS_None, // G_INDEXED_ZEXTLOAD
2120	CEFBS_None, // G_STORE
2121	CEFBS_None, // G_INDEXED_STORE
2122	CEFBS_None, // G_ATOMIC_CMPXCHG_WITH_SUCCESS
2123	CEFBS_None, // G_ATOMIC_CMPXCHG
2124	CEFBS_None, // G_ATOMICRMW_XCHG
2125	CEFBS_None, // G_ATOMICRMW_ADD
2126	CEFBS_None, // G_ATOMICRMW_SUB
2127	CEFBS_None, // G_ATOMICRMW_AND
2128	CEFBS_None, // G_ATOMICRMW_NAND
2129	CEFBS_None, // G_ATOMICRMW_OR
2130	CEFBS_None, // G_ATOMICRMW_XOR
2131	CEFBS_None, // G_ATOMICRMW_MAX
2132	CEFBS_None, // G_ATOMICRMW_MIN
2133	CEFBS_None, // G_ATOMICRMW_UMAX
2134	CEFBS_None, // G_ATOMICRMW_UMIN
2135	CEFBS_None, // G_ATOMICRMW_FADD
2136	CEFBS_None, // G_ATOMICRMW_FSUB
2137	CEFBS_None, // G_ATOMICRMW_FMAX
2138	CEFBS_None, // G_ATOMICRMW_FMIN
2139	CEFBS_None, // G_ATOMICRMW_FMAXIMUM
2140	CEFBS_None, // G_ATOMICRMW_FMINIMUM
2141	CEFBS_None, // G_ATOMICRMW_FMAXIMUMNUM
2142	CEFBS_None, // G_ATOMICRMW_FMINIMUMNUM
2143	CEFBS_None, // G_ATOMICRMW_UINC_WRAP
2144	CEFBS_None, // G_ATOMICRMW_UDEC_WRAP
2145	CEFBS_None, // G_ATOMICRMW_USUB_COND
2146	CEFBS_None, // G_ATOMICRMW_USUB_SAT
2147	CEFBS_None, // G_FENCE
2148	CEFBS_None, // G_PREFETCH
2149	CEFBS_None, // G_BRCOND
2150	CEFBS_None, // G_BRINDIRECT
2151	CEFBS_None, // G_INVOKE_REGION_START
2152	CEFBS_None, // G_INTRINSIC
2153	CEFBS_None, // G_INTRINSIC_W_SIDE_EFFECTS
2154	CEFBS_None, // G_INTRINSIC_CONVERGENT
2155	CEFBS_None, // G_INTRINSIC_CONVERGENT_W_SIDE_EFFECTS
2156	CEFBS_None, // G_ANYEXT
2157	CEFBS_None, // G_TRUNC
2158	CEFBS_None, // G_TRUNC_SSAT_S
2159	CEFBS_None, // G_TRUNC_SSAT_U
2160	CEFBS_None, // G_TRUNC_USAT_U
2161	CEFBS_None, // G_CONSTANT
2162	CEFBS_None, // G_FCONSTANT
2163	CEFBS_None, // G_VASTART
2164	CEFBS_None, // G_VAARG
2165	CEFBS_None, // G_SEXT
2166	CEFBS_None, // G_SEXT_INREG
2167	CEFBS_None, // G_ZEXT
2168	CEFBS_None, // G_SHL
2169	CEFBS_None, // G_LSHR
2170	CEFBS_None, // G_ASHR
2171	CEFBS_None, // G_FSHL
2172	CEFBS_None, // G_FSHR
2173	CEFBS_None, // G_ROTR
2174	CEFBS_None, // G_ROTL
2175	CEFBS_None, // G_ICMP
2176	CEFBS_None, // G_FCMP
2177	CEFBS_None, // G_SCMP
2178	CEFBS_None, // G_UCMP
2179	CEFBS_None, // G_SELECT
2180	CEFBS_None, // G_UADDO
2181	CEFBS_None, // G_UADDE
2182	CEFBS_None, // G_USUBO
2183	CEFBS_None, // G_USUBE
2184	CEFBS_None, // G_SADDO
2185	CEFBS_None, // G_SADDE
2186	CEFBS_None, // G_SSUBO
2187	CEFBS_None, // G_SSUBE
2188	CEFBS_None, // G_UMULO
2189	CEFBS_None, // G_SMULO
2190	CEFBS_None, // G_UMULH
2191	CEFBS_None, // G_SMULH
2192	CEFBS_None, // G_UADDSAT
2193	CEFBS_None, // G_SADDSAT
2194	CEFBS_None, // G_USUBSAT
2195	CEFBS_None, // G_SSUBSAT
2196	CEFBS_None, // G_USHLSAT
2197	CEFBS_None, // G_SSHLSAT
2198	CEFBS_None, // G_SMULFIX
2199	CEFBS_None, // G_UMULFIX
2200	CEFBS_None, // G_SMULFIXSAT
2201	CEFBS_None, // G_UMULFIXSAT
2202	CEFBS_None, // G_SDIVFIX
2203	CEFBS_None, // G_UDIVFIX
2204	CEFBS_None, // G_SDIVFIXSAT
2205	CEFBS_None, // G_UDIVFIXSAT
2206	CEFBS_None, // G_FADD
2207	CEFBS_None, // G_FSUB
2208	CEFBS_None, // G_FMUL
2209	CEFBS_None, // G_FMA
2210	CEFBS_None, // G_FMAD
2211	CEFBS_None, // G_FDIV
2212	CEFBS_None, // G_FREM
2213	CEFBS_None, // G_FMODF
2214	CEFBS_None, // G_FPOW
2215	CEFBS_None, // G_FPOWI
2216	CEFBS_None, // G_FEXP
2217	CEFBS_None, // G_FEXP2
2218	CEFBS_None, // G_FEXP10
2219	CEFBS_None, // G_FLOG
2220	CEFBS_None, // G_FLOG2
2221	CEFBS_None, // G_FLOG10
2222	CEFBS_None, // G_FLDEXP
2223	CEFBS_None, // G_FFREXP
2224	CEFBS_None, // G_FNEG
2225	CEFBS_None, // G_FPEXT
2226	CEFBS_None, // G_FPTRUNC
2227	CEFBS_None, // G_FPTOSI
2228	CEFBS_None, // G_FPTOUI
2229	CEFBS_None, // G_SITOFP
2230	CEFBS_None, // G_UITOFP
2231	CEFBS_None, // G_FPTOSI_SAT
2232	CEFBS_None, // G_FPTOUI_SAT
2233	CEFBS_None, // G_FABS
2234	CEFBS_None, // G_FCOPYSIGN
2235	CEFBS_None, // G_IS_FPCLASS
2236	CEFBS_None, // G_FCANONICALIZE
2237	CEFBS_None, // G_FMINNUM
2238	CEFBS_None, // G_FMAXNUM
2239	CEFBS_None, // G_FMINNUM_IEEE
2240	CEFBS_None, // G_FMAXNUM_IEEE
2241	CEFBS_None, // G_FMINIMUM
2242	CEFBS_None, // G_FMAXIMUM
2243	CEFBS_None, // G_FMINIMUMNUM
2244	CEFBS_None, // G_FMAXIMUMNUM
2245	CEFBS_None, // G_GET_FPENV
2246	CEFBS_None, // G_SET_FPENV
2247	CEFBS_None, // G_RESET_FPENV
2248	CEFBS_None, // G_GET_FPMODE
2249	CEFBS_None, // G_SET_FPMODE
2250	CEFBS_None, // G_RESET_FPMODE
2251	CEFBS_None, // G_GET_ROUNDING
2252	CEFBS_None, // G_SET_ROUNDING
2253	CEFBS_None, // G_PTR_ADD
2254	CEFBS_None, // G_PTRMASK
2255	CEFBS_None, // G_SMIN
2256	CEFBS_None, // G_SMAX
2257	CEFBS_None, // G_UMIN
2258	CEFBS_None, // G_UMAX
2259	CEFBS_None, // G_ABS
2260	CEFBS_None, // G_LROUND
2261	CEFBS_None, // G_LLROUND
2262	CEFBS_None, // G_BR
2263	CEFBS_None, // G_BRJT
2264	CEFBS_None, // G_VSCALE
2265	CEFBS_None, // G_INSERT_SUBVECTOR
2266	CEFBS_None, // G_EXTRACT_SUBVECTOR
2267	CEFBS_None, // G_INSERT_VECTOR_ELT
2268	CEFBS_None, // G_EXTRACT_VECTOR_ELT
2269	CEFBS_None, // G_SHUFFLE_VECTOR
2270	CEFBS_None, // G_SPLAT_VECTOR
2271	CEFBS_None, // G_STEP_VECTOR
2272	CEFBS_None, // G_VECTOR_COMPRESS
2273	CEFBS_None, // G_CTTZ
2274	CEFBS_None, // G_CTTZ_ZERO_UNDEF
2275	CEFBS_None, // G_CTLZ
2276	CEFBS_None, // G_CTLZ_ZERO_UNDEF
2277	CEFBS_None, // G_CTLS
2278	CEFBS_None, // G_CTPOP
2279	CEFBS_None, // G_BSWAP
2280	CEFBS_None, // G_BITREVERSE
2281	CEFBS_None, // G_FCEIL
2282	CEFBS_None, // G_FCOS
2283	CEFBS_None, // G_FSIN
2284	CEFBS_None, // G_FSINCOS
2285	CEFBS_None, // G_FTAN
2286	CEFBS_None, // G_FACOS
2287	CEFBS_None, // G_FASIN
2288	CEFBS_None, // G_FATAN
2289	CEFBS_None, // G_FATAN2
2290	CEFBS_None, // G_FCOSH
2291	CEFBS_None, // G_FSINH
2292	CEFBS_None, // G_FTANH
2293	CEFBS_None, // G_FSQRT
2294	CEFBS_None, // G_FFLOOR
2295	CEFBS_None, // G_FRINT
2296	CEFBS_None, // G_FNEARBYINT
2297	CEFBS_None, // G_ADDRSPACE_CAST
2298	CEFBS_None, // G_BLOCK_ADDR
2299	CEFBS_None, // G_JUMP_TABLE
2300	CEFBS_None, // G_DYN_STACKALLOC
2301	CEFBS_None, // G_STACKSAVE
2302	CEFBS_None, // G_STACKRESTORE
2303	CEFBS_None, // G_STRICT_FADD
2304	CEFBS_None, // G_STRICT_FSUB
2305	CEFBS_None, // G_STRICT_FMUL
2306	CEFBS_None, // G_STRICT_FDIV
2307	CEFBS_None, // G_STRICT_FREM
2308	CEFBS_None, // G_STRICT_FMA
2309	CEFBS_None, // G_STRICT_FSQRT
2310	CEFBS_None, // G_STRICT_FLDEXP
2311	CEFBS_None, // G_READ_REGISTER
2312	CEFBS_None, // G_WRITE_REGISTER
2313	CEFBS_None, // G_MEMCPY
2314	CEFBS_None, // G_MEMCPY_INLINE
2315	CEFBS_None, // G_MEMMOVE
2316	CEFBS_None, // G_MEMSET
2317	CEFBS_None, // G_BZERO
2318	CEFBS_None, // G_TRAP
2319	CEFBS_None, // G_DEBUGTRAP
2320	CEFBS_None, // G_UBSANTRAP
2321	CEFBS_None, // G_VECREDUCE_SEQ_FADD
2322	CEFBS_None, // G_VECREDUCE_SEQ_FMUL
2323	CEFBS_None, // G_VECREDUCE_FADD
2324	CEFBS_None, // G_VECREDUCE_FMUL
2325	CEFBS_None, // G_VECREDUCE_FMAX
2326	CEFBS_None, // G_VECREDUCE_FMIN
2327	CEFBS_None, // G_VECREDUCE_FMAXIMUM
2328	CEFBS_None, // G_VECREDUCE_FMINIMUM
2329	CEFBS_None, // G_VECREDUCE_ADD
2330	CEFBS_None, // G_VECREDUCE_MUL
2331	CEFBS_None, // G_VECREDUCE_AND
2332	CEFBS_None, // G_VECREDUCE_OR
2333	CEFBS_None, // G_VECREDUCE_XOR
2334	CEFBS_None, // G_VECREDUCE_SMAX
2335	CEFBS_None, // G_VECREDUCE_SMIN
2336	CEFBS_None, // G_VECREDUCE_UMAX
2337	CEFBS_None, // G_VECREDUCE_UMIN
2338	CEFBS_None, // G_SBFX
2339	CEFBS_None, // G_UBFX
2340	CEFBS_None, // ADCWRdRr
2341	CEFBS_None, // ADDWRdRr
2342	CEFBS_None, // ADJCALLSTACKDOWN
2343	CEFBS_None, // ADJCALLSTACKUP
2344	CEFBS_None, // ANDIWRdK
2345	CEFBS_None, // ANDWRdRr
2346	CEFBS_None, // ASRBNRd
2347	CEFBS_None, // ASRWLoRd
2348	CEFBS_None, // ASRWNRd
2349	CEFBS_None, // ASRWRd
2350	CEFBS_None, // Asr16
2351	CEFBS_None, // Asr32
2352	CEFBS_None, // Asr8
2353	CEFBS_None, // AtomicFence
2354	CEFBS_None, // AtomicLoad16
2355	CEFBS_None, // AtomicLoad8
2356	CEFBS_None, // AtomicLoadAdd16
2357	CEFBS_None, // AtomicLoadAdd8
2358	CEFBS_None, // AtomicLoadAnd16
2359	CEFBS_None, // AtomicLoadAnd8
2360	CEFBS_None, // AtomicLoadOr16
2361	CEFBS_None, // AtomicLoadOr8
2362	CEFBS_None, // AtomicLoadSub16
2363	CEFBS_None, // AtomicLoadSub8
2364	CEFBS_None, // AtomicLoadXor16
2365	CEFBS_None, // AtomicLoadXor8
2366	CEFBS_None, // AtomicStore16
2367	CEFBS_None, // AtomicStore8
2368	CEFBS_None, // COMWRd
2369	CEFBS_None, // CPCWRdRr
2370	CEFBS_None, // CPWRdRr
2371	CEFBS_None, // CopyZero
2372	CEFBS_HasELPM, // ELPMBRdZ
2373	CEFBS_HasELPMX, // ELPMBRdZPi
2374	CEFBS_HasELPM, // ELPMWRdZ
2375	CEFBS_HasELPMX, // ELPMWRdZPi
2376	CEFBS_None, // EORWRdRr
2377	CEFBS_None, // FRMIDX
2378	CEFBS_None, // INWRdA
2379	CEFBS_HasSRAM, // LDDWRdPtrQ
2380	CEFBS_HasSRAM, // LDDWRdYQ
2381	CEFBS_None, // LDIWRdK
2382	CEFBS_HasSRAM_HasNonTinyEncoding, // LDSWRdK
2383	CEFBS_HasSRAM, // LDWRdPtr
2384	CEFBS_HasSRAM, // LDWRdPtrPd
2385	CEFBS_HasSRAM, // LDWRdPtrPi
2386	CEFBS_HasLPM, // LPMBRdZ
2387	CEFBS_HasLPM, // LPMWRdZ
2388	CEFBS_HasLPMX, // LPMWRdZPi
2389	CEFBS_None, // LSLBNRd
2390	CEFBS_None, // LSLWHiRd
2391	CEFBS_None, // LSLWNRd
2392	CEFBS_None, // LSLWRd
2393	CEFBS_None, // LSRBNRd
2394	CEFBS_None, // LSRWLoRd
2395	CEFBS_None, // LSRWNRd
2396	CEFBS_None, // LSRWRd
2397	CEFBS_None, // Lsl16
2398	CEFBS_None, // Lsl32
2399	CEFBS_None, // Lsl8
2400	CEFBS_None, // Lsr16
2401	CEFBS_None, // Lsr32
2402	CEFBS_None, // Lsr8
2403	CEFBS_None, // NEGWRd
2404	CEFBS_None, // ORIWRdK
2405	CEFBS_None, // ORWRdRr
2406	CEFBS_None, // OUTWARr
2407	CEFBS_HasSRAM, // POPWRd
2408	CEFBS_HasSRAM, // PUSHWRr
2409	CEFBS_HasNonTinyEncoding, // ROLBRdR1
2410	CEFBS_HasTinyEncoding, // ROLBRdR17
2411	CEFBS_None, // ROLWRd
2412	CEFBS_None, // RORBRd
2413	CEFBS_None, // RORWRd
2414	CEFBS_None, // Rol16
2415	CEFBS_None, // Rol8
2416	CEFBS_None, // Ror16
2417	CEFBS_None, // Ror8
2418	CEFBS_None, // SBCIWRdK
2419	CEFBS_None, // SBCWRdRr
2420	CEFBS_None, // SEXT
2421	CEFBS_None, // SPREAD
2422	CEFBS_None, // SPWRITE
2423	CEFBS_None, // STDSPQRr
2424	CEFBS_HasSRAM, // STDWPtrQRr
2425	CEFBS_None, // STDWSPQRr
2426	CEFBS_HasSRAM_HasNonTinyEncoding, // STSWKRr
2427	CEFBS_HasSRAM, // STWPtrPdRr
2428	CEFBS_HasSRAM, // STWPtrPiRr
2429	CEFBS_HasSRAM, // STWPtrRr
2430	CEFBS_None, // SUBIWRdK
2431	CEFBS_None, // SUBWRdRr
2432	CEFBS_None, // Select16
2433	CEFBS_None, // Select8
2434	CEFBS_None, // ZEXT
2435	CEFBS_None, // ADCRdRr
2436	CEFBS_None, // ADDRdRr
2437	CEFBS_HasADDSUBIW, // ADIWRdK
2438	CEFBS_None, // ANDIRdK
2439	CEFBS_None, // ANDRdRr
2440	CEFBS_None, // ASRRd
2441	CEFBS_None, // BCLRs
2442	CEFBS_None, // BLD
2443	CEFBS_None, // BRBCsk
2444	CEFBS_None, // BRBSsk
2445	CEFBS_HasBREAK, // BREAK
2446	CEFBS_None, // BREQk
2447	CEFBS_None, // BRGEk
2448	CEFBS_None, // BRLOk
2449	CEFBS_None, // BRLTk
2450	CEFBS_None, // BRMIk
2451	CEFBS_None, // BRNEk
2452	CEFBS_None, // BRPLk
2453	CEFBS_None, // BRSHk
2454	CEFBS_None, // BSETs
2455	CEFBS_None, // BST
2456	CEFBS_HasJMPCALL, // CALLk
2457	CEFBS_None, // CBIAb
2458	CEFBS_None, // COMRd
2459	CEFBS_None, // CPCRdRr
2460	CEFBS_None, // CPIRdK
2461	CEFBS_None, // CPRdRr
2462	CEFBS_None, // CPSE
2463	CEFBS_None, // DECRd
2464	CEFBS_HasDES, // DESK
2465	CEFBS_HasEIJMPCALL, // EICALL
2466	CEFBS_HasEIJMPCALL, // EIJMP
2467	CEFBS_HasELPM, // ELPM
2468	CEFBS_HasELPMX, // ELPMRdZ
2469	CEFBS_HasELPMX, // ELPMRdZPi
2470	CEFBS_None, // EORRdRr
2471	CEFBS_SupportsMultiplication, // FMUL
2472	CEFBS_SupportsMultiplication, // FMULS
2473	CEFBS_SupportsMultiplication, // FMULSU
2474	CEFBS_HasIJMPCALL, // ICALL
2475	CEFBS_HasIJMPCALL, // IJMP
2476	CEFBS_None, // INCRd
2477	CEFBS_None, // INRdA
2478	CEFBS_HasJMPCALL, // JMPk
2479	CEFBS_SupportsRMW, // LACZRd
2480	CEFBS_SupportsRMW, // LASZRd
2481	CEFBS_SupportsRMW, // LATZRd
2482	CEFBS_HasSRAM_HasNonTinyEncoding, // LDDRdPtrQ
2483	CEFBS_None, // LDIRdK
2484	CEFBS_HasSRAM, // LDRdPtr
2485	CEFBS_HasSRAM, // LDRdPtrPd
2486	CEFBS_HasSRAM, // LDRdPtrPi
2487	CEFBS_HasSRAM_HasNonTinyEncoding, // LDSRdK
2488	CEFBS_HasSRAM_HasTinyEncoding, // LDSRdKTiny
2489	CEFBS_HasLPM, // LPM
2490	CEFBS_HasLPMX, // LPMRdZ
2491	CEFBS_HasLPMX, // LPMRdZPi
2492	CEFBS_None, // LSRRd
2493	CEFBS_None, // MOVRdRr
2494	CEFBS_HasMOVW, // MOVWRdRr
2495	CEFBS_SupportsMultiplication, // MULRdRr
2496	CEFBS_SupportsMultiplication, // MULSRdRr
2497	CEFBS_SupportsMultiplication, // MULSURdRr
2498	CEFBS_None, // NEGRd
2499	CEFBS_None, // NOP
2500	CEFBS_None, // ORIRdK
2501	CEFBS_None, // ORRdRr
2502	CEFBS_None, // OUTARr
2503	CEFBS_HasSRAM, // POPRd
2504	CEFBS_HasSRAM, // PUSHRr
2505	CEFBS_None, // RCALLk
2506	CEFBS_None, // RET
2507	CEFBS_None, // RETI
2508	CEFBS_None, // RJMPk
2509	CEFBS_None, // RORRd
2510	CEFBS_None, // SBCIRdK
2511	CEFBS_None, // SBCRdRr
2512	CEFBS_None, // SBIAb
2513	CEFBS_None, // SBICAb
2514	CEFBS_None, // SBISAb
2515	CEFBS_HasADDSUBIW, // SBIWRdK
2516	CEFBS_None, // SBRCRrB
2517	CEFBS_None, // SBRSRrB
2518	CEFBS_None, // SLEEP
2519	CEFBS_HasSPM, // SPM
2520	CEFBS_HasSPMX, // SPMZPi
2521	CEFBS_HasSRAM_HasNonTinyEncoding, // STDPtrQRr
2522	CEFBS_HasSRAM, // STPtrPdRr
2523	CEFBS_HasSRAM, // STPtrPiRr
2524	CEFBS_HasSRAM, // STPtrRr
2525	CEFBS_HasSRAM_HasNonTinyEncoding, // STSKRr
2526	CEFBS_HasSRAM_HasTinyEncoding, // STSKRrTiny
2527	CEFBS_None, // SUBIRdK
2528	CEFBS_None, // SUBRdRr
2529	CEFBS_None, // SWAPRd
2530	CEFBS_None, // WDR
2531	CEFBS_SupportsRMW, // XCHZRd
2532	};
2533
2534	assert(Opcode < `517`);
2535	return FeatureBitsets[RequiredFeaturesRefs[Opcode]];
2536	}
2537
2538
2539	} // namespace llvm::AVR_MC
2540
2541	#endif // GET_COMPUTE_FEATURES
2542
2543	#ifdef GET_AVAILABLE_OPCODE_CHECKER
2544	#undef GET_AVAILABLE_OPCODE_CHECKER
2545
2546	namespace llvm::AVR_MC {
2547
2548	bool isOpcodeAvailable(unsigned Opcode, const FeatureBitset &Features) {
2549	FeatureBitset AvailableFeatures = computeAvailableFeatures(Features);
2550	FeatureBitset RequiredFeatures = computeRequiredFeatures(Opcode);
2551	FeatureBitset MissingFeatures =
2552	(AvailableFeatures & RequiredFeatures) ^
2553	RequiredFeatures;
2554	return !MissingFeatures.any();
2555	}
2556
2557	} // namespace llvm::AVR_MC
2558
2559	#endif // GET_AVAILABLE_OPCODE_CHECKER
2560
2561	#ifdef ENABLE_INSTR_PREDICATE_VERIFIER
2562	#undef ENABLE_INSTR_PREDICATE_VERIFIER
2563
2564	#include <sstream>
2565
2566	namespace llvm::AVR_MC {
2567
2568	#ifndef NDEBUG
2569	static const char *SubtargetFeatureNames[] = {
2570	"Feature_HasADDSUBIW",
2571	"Feature_HasBREAK",
2572	"Feature_HasDES",
2573	"Feature_HasEIJMPCALL",
2574	"Feature_HasELPM",
2575	"Feature_HasELPMX",
2576	"Feature_HasIJMPCALL",
2577	"Feature_HasJMPCALL",
2578	"Feature_HasLPM",
2579	"Feature_HasLPMX",
2580	"Feature_HasMOVW",
2581	"Feature_HasNonTinyEncoding",
2582	"Feature_HasSPM",
2583	"Feature_HasSPMX",
2584	"Feature_HasSRAM",
2585	"Feature_HasSmallStack",
2586	"Feature_HasTinyEncoding",
2587	"Feature_SupportsMultiplication",
2588	"Feature_SupportsRMW",
2589	nullptr
2590	};
2591
2592	#endif // NDEBUG
2593
2594	void verifyInstructionPredicates(
2595	unsigned Opcode, const FeatureBitset &Features) {
2596	#ifndef NDEBUG
2597	FeatureBitset AvailableFeatures = computeAvailableFeatures(Features);
2598	FeatureBitset RequiredFeatures = computeRequiredFeatures(Opcode);
2599	FeatureBitset MissingFeatures =
2600	(AvailableFeatures & RequiredFeatures) ^
2601	RequiredFeatures;
2602	if (MissingFeatures.any()) {
2603	std::ostringstream Msg;
2604	Msg << "Attempting to emit " << &AVRInstrNameData[AVRInstrNameIndices[Opcode]]
2605	<< " instruction but the ";
2606	for (unsigned i = `0`, e = MissingFeatures.size(); i != e; ++i)
2607	if (MissingFeatures.test(i))
2608	Msg << SubtargetFeatureNames[i] << " ";
2609	Msg << "predicate(s) are not met";
2610	report_fatal_error(Msg.str().c_str());
2611	}
2612	#endif // NDEBUG
2613	}
2614
2615	} // namespace llvm::AVR_MC
2616
2617	#endif // ENABLE_INSTR_PREDICATE_VERIFIER
2618
2619

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